參數(shù)資料
型號： ADSP-BF535PKB-350
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號處理
英文描述： Blackfin Embedded Processor
中文描述： 32-BIT, 40 MHz, OTHER DSP, PBGA260
封裝： PLASTIC, MS-034AAG-1, BGA-260
文件頁數(shù)： 32/44頁
文件大?。?/td> 1388K
代理商： ADSP-BF535PKB-350
ADSP-BF535
–32–
REV. A
Serial Peripheral Interface (SPI) Port
—Master Timing
Table 23
and
Figure 15
describe SPI port master operations.
Table 23. Serial Peripheral Interface (SPI) Port—Master Timing
Parameter
Timing Requirements
t
SSPID
t
HSPID
Min
Max
Unit
Data Input Valid to SCK Edge (Data Input Setup)
SCK Sampling Edge to Data Input Invalid
6.5
1.6
ns
ns
Switching Characteristics
t
SDSCIM
t
SPICHM
t
SPICLM
t
SPICLK
t
HDSM
t
SPITDM
t
DDSPID
t
HDSPID
SPIxSEL
Low to First SCK Edge (x=0 or 1)
Serial Clock High Period
Serial Clock Low Period
Serial Clock Period
Last SCK Edge to
SPIxSEL
High (x=0 or 1)
Sequential Transfer Delay
SCK Edge to Data Out Valid (Data Out Delay)
SCK Edge to Data Out Invalid (Data Out Hold)
(2
(2
(2
4
(2
2
0.0
0.0
t
SCLK
) – 3
t
SCLK
) – 3
t
SCLK
) – 3
t
SCLK
t
SCLK
) – 3
t
SCLK
ns
ns
ns
ns
ns
ns
ns
ns
6.0
5.0
Figure 15. Serial Peripheral Interface (SPI) Port—Master Timing
t
SSPID
t
HSPID
t
HDSPID
LSB
MSB
t
HSPID
t
DDSPID
MOSI
(OUTPUT)
MISO
(INPUT)
SPIxSEL
(OUTPUT)
(x = 0 OR 1)
SCK
(CPOL = 0)
(OUTPUT)
SCK
(CPOL = 1)
(OUTPUT)
t
SPICHM
t
SPICLM
t
SPICLM
t
SPICLK
t
SPICHM
t
HDSM
t
SPITDM
t
HDSPID
LSB
VALID
LSB
MSB
MSB
VALID
t
HSPID
t
DDSPID
MOSI
(OUTPUT)
MISO
(INPUT)
t
SSPID
CPHA = 1
CPHA = 0
MSB
VALID
t
SDSCIM
t
SSPID
LSB
VALID
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