參數(shù)資料
型號(hào)： ADSP-2163BS-100
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號(hào)處理
英文描述： 100V 1A ULTRA FAST LOW-LOSS CONTROLLED AVALANCHE RECTIFIER, SMA US1 SERIES, DO-
中文描述： 24-BIT, 25 MHz, OTHER DSP, PQFP80
封裝： METRIC, PLASTIC, QFP-80
文件頁(yè)數(shù)： 25/39頁(yè)
文件大小： 243K
代理商： ADSP-2163BS-100
REV. 0
ADSP-216x
–25–
TIMING PARAMETERS (ADSP-2161/ADSP-2163/ADSP-2165)
MEMORY READ
16.67 MHz
Min
20 MHz
Min
25 MHz
Min
Parameter
Max
Max
Max
Unit
Timing Requirements:
t
RDD
RD
Low to Data Valid
t
AA
A0–A13,
PMS
,
DMS
,
BMS
to Data Valid
t
RDH
Data Hold from
RD
High
Switching Characteristics:
t
RP
RD
Pulsewidth
t
CRD
CLKOUT High to
RD
Low
t
ASR
A0–A13,
PMS
,
DMS
,
BMS
Setup Before RD Low
t
RDA
A0–A13,
PMS
,
DMS
,
BMS
Hold After
RD
Deasserted
t
RWR
RD
High to
RD
or
WR
Low
17
27
12
19.5
7
12
ns
ns
ns
0
0
0
22
10
5
6
25
17
7.5
2.5
3.5
20
12
5
1.5
1
1
15
ns
ns
ns
ns
ns
25
22.5
20
Frequency Dependency
(CLKIN
≤
25 MHz)
Parameter
Min
Max
Unit
Timing Requirements:
t
RDD
RD
Low to Data Valid
t
AA
A0–A13,
PMS
,
DMS
,
BMS
to Data Valid
t
RDH
Data Hold from
RD
High
Switching Characteristics:
t
RP
RD
Pulsewidth
t
CRD
CLKOUT High to
RD
Low
t
ASR
A0–A13,
PMS
,
DMS
,
BMS
Setup Before
RD
Low
t
RDA
A0–A13,
PMS
,
DMS
,
BMS
Hold After
RD
Deasserted
t
RWR
RD
High to
RD
or
WR
Low
0.5t
CK
– 13 + w
0.75t
CK
– 18 + w
ns
ns
0
0.5t
CK
– 8 + w
0.25t
CK
– 5
0.25t
CK
– 10
1
0.25t
CK
– 9
0.5t
CK
– 5
ns
ns
ns
ns
ns
0.25t
CK
+ 10
NOTES
1
For 25 MHz only, minimum frequency dependency formula for t
ASR
= (0.25t
CK
– 8.5).
w = wait states
×
t
CK.
CLKOUT
A0–A13
D
t
RDA
t
RWR
t
RP
t
ASR
t
CRD
t
RDD
t
AA
t
RDH
DMS
,
PMS
,
BMS
RD
WR
Figure 24. Memory Read
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PDF描述
ADSP-2163BS-66 DSP Microcomputers with ROM
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ADSP-2163KS-66 DSP Microcomputers with ROM
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ADSP-2164KS-40 DSP Microcomputers with ROM
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