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參數資料
| 型號： | ADCLK944BCPZ-WP |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 6/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK BUFFER 1:4 7GHZ 16LFCSP |
| 標準包裝： | 50 |
| 系列： | SIGe |
| 類型： | 扇出緩沖器（分配） |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 1:4 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | CML，CMOS，LVDS，LVPECL |
| 輸出： | ECL，LVPECL |
| 頻率 - 最大： | 7GHz |
| 電源電壓： | 2.375 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-WFQFN 裸露焊盤，CSP |
| 供應商設備封裝： | 16-LFCSP-WQ（3x3） |
| 包裝： | 托盤 - 晶粒 |
ADCLK944
Rev. 0 | Page 3 of 12
SPECIFICATIONS
Typical values are given for VCC VEE = 3.3 V and TA = 25°C, unless otherwise noted. Minimum and maximum values are given for the
full VCC VEE = 3.3 V + 10% to 2.5 V 5% and TA = 40°C to +85°C variation, unless otherwise noted.
CLOCK INPUTS AND OUTPUTS
Table 1.
Parameter
Symbol
Min
Typ
Max
Unit
Test Conditions/Comments
DC INPUT CHARACTERISTICS
Input Common-Mode Voltage
VICM
VEE + 1.35
VCC 0.1
V
Input Differential Voltage
VID
0.4
3.4
V p-p
±1.7 V between input pins
Input Capacitance
CIN
0.4
pF
Input Resistance
RIN
Single-Ended Mode
50
Ω
Differential Mode
100
Ω
Common Mode
50
kΩ
VT open
Input Bias Current
20
μA
DC OUTPUT CHARACTERISTICS
Output Voltage High Level
VOH
VCC 1.26
VCC 0.76
V
Load = 50 Ω to (VCC 2.0 V)
Output Voltage Low Level
VOL
VCC 1.99
VCC 1.54
V
Load = 50 Ω to (VCC 2.0 V)
Output Voltage, Single-Ended
VO
600
960
mV
VOH VOL, output static
Voltage Reference
VREF
Output Voltage
(VCC + 1)/2
V
500 μA to +500 μA
Output Resistance
250
Ω
TIMING CHARACTERISTICS
Table 2.
Parameter
Symbol
Min
Typ
Max
Unit
Test Conditions/Comments
AC PERFORMANCE
Maximum Output Frequency
6.2
7.0
GHz
Differential output voltage swing > 0.8 V
(see Figure 4)
Output Rise/Fall Time
tR
35
50
75
ps
20% to 80%, measured differentially
Propagation Delay
tPD
70
100
130
ps
VID = 1.6 V p-p
Temperature Coefficient
75
fs/°C
Output-to-Output Skew1
15
ps
Part-to-Part Skew
35
ps
VID = 1.6 V p-p
Additive Time Jitter
Integrated Random Jitter
26
fs rms
BW = 12 kHz to 20 MHz, CLK = 1 GHz
Broadband Random Jitter2
50
fs rms
VID = 1.6 V p-p, 8 V/ns, VICM = 2 V
CLOCK OUTPUT PHASE NOISE
Absolute Phase Noise
Input slew rate > 1 V/ns (see Figure 11)
fIN = 1 GHz
118
dBc/Hz
100 Hz offset
135
dBc/Hz
1 kHz offset
144
dBc/Hz
10 kHz offset
150
dBc/Hz
100 kHz offset
150
dBc/Hz
>1 MHz offset
1 The output-to-output skew is the difference between any two similar delay paths while operating at the same voltage and temperature.
2 Measured at the rising edge of the clock signal; calculated using the SNR of the ADC method.
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PDF描述 |
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