VREF V<" />
參數(shù)資料
型號: ADCLK925BCPZ-WP
廠商: Analog Devices Inc
文件頁數(shù): 4/16頁
文件大?。?/td> 0K
描述: IC CLOCK/DATA BUFFER 1:2 16LFCSP
標(biāo)準(zhǔn)包裝: 50
系列: SIGe
類型: 扇出緩沖器(分配),數(shù)據(jù)
電路數(shù): 1
比率 - 輸入:輸出: 1:2
差分 - 輸入:輸出: 是/是
輸入: 時鐘
輸出: ECL,NECL,PECL
頻率 - 最大: 7.5GHz
電源電壓: 2.375 V ~ 3.63 V
工作溫度: -40°C ~ 125°C
安裝類型: 表面貼裝
封裝/外殼: 16-VFQFN 裸露焊盤,CSP
供應(yīng)商設(shè)備封裝: 16-LFCSP-VQ
包裝: 托盤 - 晶粒
配用: ADCLK925/PCBZ-ND - BOARD EVAL FOR ADCLK925 16LFCSP
ADCLK905/ADCLK907/ADCLK925
Rev. 0 | Page 12 of 16
TYPICAL APPLICATION CIRCUITS
VREF
VCC
VT
D
06
31
8-
02
6
CONNECT VT TO VCC.
Figure 26. Interfacing to CML Inputs
VREF
VCC –2V
VT
D
06
31
8-
0
28
CONNECT VT TO VCC 2V.
Figure 27. Interfacing to PECL
VREF
VT
D
06
31
8-
0
29
NOTES
1. PLACING A BYPASS CAPACITOR
FROM VT TO GROUND CAN IMPROVE
THE NOISE PERFORMANCE.
CONNECT VT TO VREF.
Figure 28. AC Coupling Differential Signals
VREF
VT
D
06
31
8-
0
30
CONNECT VT,VREF, AND D. PLACE A BYPASS
CAPACITOR FROM VT TO GROUND.
ALTERNATIVELY, VT,VREF, AND D CAN BE
CONNECTED, GIVING A CLEANER LAYOUT AND
A 180 PHASE SHIFT.
Figure 29. Interfacing to AC-Coupled Single-Ended Inputs
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ADCLK944BCPZ-WP 功能描述:IC CLOCK BUFFER 1:4 7GHZ 16LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘緩沖器,驅(qū)動器 系列:SIGe 產(chǎn)品培訓(xùn)模塊:High Bandwidth Product Overview 標(biāo)準(zhǔn)包裝:1,000 系列:Precision Edge® 類型:扇出緩沖器(分配) 電路數(shù):1 比率 - 輸入:輸出:1:4 差分 - 輸入:輸出:是/是 輸入:CML,LVDS,LVPECL 輸出:CML 頻率 - 最大:2.5GHz 電源電壓:2.375 V ~ 2.625 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-VFQFN 裸露焊盤,16-MLF? 供應(yīng)商設(shè)備封裝:16-MLF?(3x3) 包裝:帶卷 (TR)