參數(shù)資料
型號： AD9481BSUZ-250
廠商： Analog Devices Inc
文件頁數(shù)： 28/28頁
文件大?。?/td> 0K
描述： IC ADC 8BIT 250MSPS 3.3V 44-TQFP
標準包裝： 1
位數(shù)： 8
采樣率（每秒）： 250M
數(shù)據(jù)接口： 并聯(lián)
轉換器數(shù)目： 1
功率耗散（最大）： 439mW
電壓電源： 單電源
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-TQFP
供應商設備封裝： 44-TQFP（10x10）
包裝： 托盤
輸入數(shù)目和類型： 2 個單端，單極；2 個差分，單極
產(chǎn)品目錄頁面： 780 (CN2011-ZH PDF)
配用： AD9481-PCBZ-ND - BOARD EVAL 8BIT 250MSPS 44-TQFP
AD9481
Rev. 0 | Page 9 of 28
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
1
2
3
4
5
6
7
8
9
10
11
12
CLK–
AVDD
AGND
D7A (MSB)
DRGND
DRVDD
CLK+
D6A
D5A
D4A
D3A
33
32
31
30
29
28
27
26
25
24
23
AGND
AVDD
DRGND
S1
PDWN
SENSE
D7B (MSB)
D6B
D5B
D4B
D2
A
13
D1
A
14
D0
A
(LS
B
)
15
DRGND
16
DCO–
17
DCO+
18
DRV
DD
19
D0
B
(LS
B
)
20
D1
B
21
D2
B
22
D3
B
PIN 1
44
DS
+
43
DS
–
42
S3
41
AV
DD
40
AGND
39
VIN
+
38
VIN
–
37
AGND
36
AV
DD
35
AGND
34
VR
EF
AD9481
TOP VIEW
(Not to Scale)
05045-003
Figure 3. Pin Configuration
Table 7. Pin Function Descriptions
Pin
No.
Name
Description
1
CLK+
Input Clock—True
2
CLK
Input Clock—Complement
3
AVDD
3.3 V Analog Supply
4
AGND
Analog Ground
5
DRVDD
3.3 V Digital Output Supply
6
DRGND
Digital Ground
7
D7A
Data Output Bit 7—Channel A (MSB)
8
D6A
Data Output Bit 6—Channel A
9
D5A
Data Output Bit 5—Channel A
10
D4A
Data Output Bit 4—Channel A
11
D3A
Data Output Bit 3—Channel A
12
D2A
Data Output Bit 2—Channel A
13
D1A
Data Output Bit 1—Channel A
14
D0A
Data Output Bit 0—Channel A (LSB)
15
DRGND
Digital Ground
16
DCO
Data Clock Output—Complement
17
DCO+
Data Clock Output—True
18
DRVDD
3.3 V Digital Output Supply
19
D0B
Data Output Bit 0—Channel B (LSB)
20
D1B
Data Output Bit 1—Channel B
21
D2B
Data Output Bit 2—Channel B
22
D3B
Data Output Bit 3—Channel B
23
D4B
Data Output Bit 4—Channel B
24
D5B
Data Output Bit 5—Channel B
Pin
No.
Name
Description
25
D6B
Data Output Bit 6—Channel B
26
D7B
Data Output Bit 7—Channel B (MSB)
27
DRGND
Digital Ground
28
S1
Data Format Select and Duty Cycle Stabilizer
Select
29
PDWN
Power-Down Selection
30
AVDD
3.3 V Analog Supply
31
AVDD
3.3 V Analog Supply
32
AGND
Analog Ground
33
SENSE
Reference Mode Selection
34
VREF
Voltage Reference Input/Output
35
AGND
Analog Ground
36
AVDD
3.3 V Analog Supply
37
AGND
Analog Ground
38
VIN
Analog Input—Complement
39
VIN+
Analog Input—True
40
AGND
Analog Ground
41
AVDD
3.3 V Analog Supply
42
S3
DCO Enable Select (Tie to AVDD for DCO
Active)
43
DS
Data Sync Complement (If Unused, Tie to
DRVDD)
44
DS+
Data Sync True (If Unused, Tie to DGND)
相關PDF資料
PDF描述
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