TIMING SPECIFICATIONS1 Parameter Limit at TMI" />
參數(shù)資料
型號： AD7836ASZ
廠商： Analog Devices Inc
文件頁數(shù)： 6/12頁
文件大?。?/td> 0K
描述： IC DAC 14BIT QUAD LC2MOS 44MQFP
產(chǎn)品培訓(xùn)模塊： Data Converter Fundamentals
DAC Architectures
標(biāo)準(zhǔn)包裝： 1
設(shè)置時間： 16µs
位數(shù)： 14
數(shù)據(jù)接口： 并聯(lián)
轉(zhuǎn)換器數(shù)目： 4
電壓電源： 模擬和數(shù)字，雙 ±
功率耗散（最大）： 460mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-QFP
供應(yīng)商設(shè)備封裝： 44-MQFP（10x10）
包裝： 托盤
輸出數(shù)目和類型： 4 電壓，單極；4 電壓，雙極
采樣率（每秒）： 62.5k
AD7836
–3–
REV. A
TIMING SPECIFICATIONS1
Parameter
Limit at TMIN, TMAX
Units
Description
t1
15
ns min
A0, A1, A2 to WR Setup Time
t2
0
ns min
A0, A1, A2 to WR Hold Time
t3
0
ns min
CS to WR Setup Time
t4
0
ns min
WR to CS Hold Time
t5
44
ns min
WR Pulsewidth
t6
15
ns min
Data Setup Time
t7
4.5
ns min
Data Hold Time
t8
44
ns min
WR Pulse Interval
t9
16
s typ
Settling Time
t10
300
ns max
CLR Pulse Activation Time
NOTES
1All input signals are specified with tr = tf = 5 ns (10% to 90% of 5 V) and timed from a voltage level of 1.6 V.
2Rise and fall times should be no longer than 50 ns.
Specifications subject to change without notice.
(VCC = +5 V
5%; VDD = +15 V
5%; VSS = –15 V
5%; AGND = DGND = 0 V)
t2
t1
t3
t4
t5
t8
t6
t7
t9
t10
DATA
WR
CS
VOUT
CLR
A0, A1, A2
VOUT
Figure 1. Timing Diagram
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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AD7837AN/883B 制造商:AD 制造商全稱:Analog Devices 功能描述:LC2MOS Complete, Dual 12-Bit MDACs
AD7837AN883B 制造商:AD 制造商全稱:Analog Devices 功能描述:LC2MOS Complete, Dual 12-Bit MDACs
AD7837AN-883B 制造商:AD 制造商全稱:Analog Devices 功能描述:LC2MOS Complete, Dual 12-Bit MDACs
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