TA = +25 CTA" />
參數(shù)資料
型號： AD7568BPZ-REEL
廠商： Analog Devices Inc
文件頁數(shù)： 8/14頁
文件大?。?/td> 0K
描述： IC DAC 12BIT LC2MOS OCTAL 44PLCC
產(chǎn)品培訓模塊： Data Converter Fundamentals
DAC Architectures
標準包裝： 500
設置時間： 500ns
位數(shù)： 12
數(shù)據(jù)接口： 串行
轉換器數(shù)目： 8
電壓電源： 單電源
功率耗散（最大）： 17.5mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應商設備封裝： 44-PLCC（16.59x16.59）
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 16 電流，單極；16 電流，雙極
采樣率（每秒）： 2M
AD7568
–3–
TIMING SPECIFICATIONS
Limit at
Parameter
TA = +25 CTA = –40 C to +85 C
Units
Description
t1
100
ns min
CLKIN Cycle Time
t2
40
ns min
CLKIN High Time
t3
40
ns min
CLKIN Low Time
t4
30
ns min
FSIN
Setup Time
t5
30
ns min
Data Setup Time
t6
5
ns min
Data Hold Time
t7
90
ns min
FSIN
Hold Time
70
ns max
SDOUT Valid After CLKIN Falling Edge
t9
40
ns min
LDAC
, CLR Pulse Width
NOTES
1Sample tested at +25
°C to ensure compliance. All input signals are specified with tr = tf = 5 ns (10% to 90% of 5 V) and timed from a voltage level of 1.6 V.
2t
8 is measured with the load circuit of Figure 2 and defined as the time required for the output to cross 0.8 V or 2.4 V.
CLKIN (I)
SDIN (I)
SDOUT (O)
DB15
DB0
DB15
DB0
FSIN (I)
LDAC, CLR
t1
t4
t
7
t2
t 3
t 6
t 5
t 8
t 9
NOTES
1. AO IS HARDWIRED HIGH OR LOW.
Figure 1. Timing Diagram
(VDD = +5 V
5%; IOUT1 = IOUT2 = 0 V; TA = TMIN to TMAX, unless otherwise noted)
1.6mA
I OL
+2.1V
I
OH
200
A
C L
50pF
TO OUTPUT
PIN
Figure 2. Load Circuit for Digital Output
Timing Specifications
REV. C
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AD7568BSZ-REEL 功能描述:IC DAC 12BIT OCTAL LC2MOS 44MQFP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉換器 系列:- 產(chǎn)品培訓模塊:Data Converter Fundamentals DAC Architectures 標準包裝:750 系列:- 設置時間:7µs 位數(shù):16 數(shù)據(jù)接口:并聯(lián) 轉換器數(shù)目:1 電壓電源:雙 ± 功率耗散（最大）:100mW 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-LCC（J 形引線） 供應商設備封裝:28-PLCC（11.51x11.51） 包裝:帶卷 (TR) 輸出數(shù)目和類型:1 電壓，單極；1 電壓，雙極 采樣率（每秒）:143k
AD7569ACHIPS 功能描述:Analog I/O Interface Die 制造商:analog devices inc. 系列:LC2MOS 包裝:- 零件狀態(tài):上次購買時間 應用:模擬 I/O 接口:總線 電壓 - 電源:4.75 V ~ 5.25 V 封裝/外殼:- 供應商器件封裝:模具 安裝類型:表面貼裝 標準包裝:1
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