參數(shù)資料
型號： AD5662ARJ-1
廠商： ANALOG DEVICES INC
元件分類： DAC
英文描述： 2.7 V to 5.5 V, 250 ??A, Rail-to-Rail Output 16-Bit DAC D/A in a SOT-23
中文描述： SERIAL INPUT LOADING, 8 us SETTLING TIME, 16-BIT DAC, PDSO8
封裝： MO-178-BA, SOT-23, 8 PIN
文件頁數(shù)： 5/20頁
文件大?。?/td> 357K
代理商： AD5662ARJ-1
Preliminary Technical Data
AD5662
TIMING CHARACTERISTICS
All input signals are specified with tr = tf = 1 ns/V (10% to 90% of V
DD
) and timed from a voltage level of (V
IL
+ V
IH
)/2. See Figure 2.
V
DD
= 2.7 V to 5.5 V; all specifications T
MIN
to T
MAX
, unless otherwise noted.
Table 2.
Limit at T
MIN
, T
MAX
Parameter
V
DD
= 2.7 V to 3.6 V
V
DD
= 3.6 V to 5.5 V
t
11
50
33
t
2
13
13
t
3
13
13
t
4
0
0
t
5
5
5
t
6
4.5
4.5
t
7
0
0
t
8
50
33
t
9
13
13
t
10
0
0
Rev. PrA | Page 5 of 20
Unit
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns min
Conditions/Comments
SCLK cycle time
SCLK high time
SCLK low time
SYNC to SCLK falling edge setup time
Data setup time
Data hold time
SCLK falling edge to SYNC rising edge
Minimum SYNC high time
SYNC rising edge to sclk fall ignore
SCLK falling edge to SYNC fall ignore
1
Maximum SCLK frequency is 30 MHz at V
DD
= 3.6 V to 5.5 V, and 20 MHz at V
DD
= 2.7 V to 3.6 V.
DIN
SYNC
SCLK
DB23
DB0
t
9
t
10
t
4
t
3
t
2
t
7
t
6
t
5
t
1
t
8
0
Figure 2. Serial Write Operation
相關PDF資料
PDF描述
AD5662 2.7 V to 5.5 V, 250 ??A, Rail-to-Rail Output 16-Bit DAC D/A in a SOT-23
AD5662ARM 2.7 V to 5.5 V, 250 ??A, Rail-to-Rail Output 16-Bit DAC D/A in a SOT-23
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參數(shù)描述
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