參數(shù)資料
型號(hào)： AD5662ARJ-1
廠商： ANALOG DEVICES INC
元件分類(lèi)： DAC
英文描述： 2.7 V to 5.5 V, 250 ??A, Rail-to-Rail Output 16-Bit DAC D/A in a SOT-23
中文描述： SERIAL INPUT LOADING, 8 us SETTLING TIME, 16-BIT DAC, PDSO8
封裝： MO-178-BA, SOT-23, 8 PIN
文件頁(yè)數(shù)： 12/20頁(yè)
文件大?。?/td> 357K
代理商： AD5662ARJ-1
AD5662
Preliminary Technical Data
Rev. PrA | Page 12 of 20
SAMPLE NUMBER
A
2.500400
2.500300
2.500200
2.500100
2.500000
2.499900
2.499800
2.499700
2.499600
2.499500
2.499400
2.499300
2.499200
2.499100
V
DD
= V
REF
= 5V
T
= 25
°
13nS/SAMPLE NUMBER
1 LSB CHANGE AROUND
MIDSCALE (7FFFh
→
8000h)
GLITCH IMPULSE = 1.271nV.s
300
350
400
0
150
200
250
50
100
450
500 550
0
Figure 22. Digital-to-Analog Glitch Impulse (Positive)
SAMPLE NUMBER
A
2.500250
2.500200
2.500150
2.500100
2.500050
2.500000
2.499950
2.499900
2.499850
2.499800
2.499750
2.499700
2.499650
2.499600
0
150
200
250
50
100
300
350
400
450
500 550
0
V
DD
= V
REF
= 5V
T
= 25
°
20nS/SAMPLE NUMBER
DAC LOADED WITH MIDSCALE
DIGITAL FEEDTHROUGH = 0.06nV.s
Figure 23. Digital Feedthrough
Hz
d
–20
–50
–80
–30
–40
–60
–70
–90
–100
2k
4k
6k
8k
10k
0
V
DD
= 5V
T
= 25
°
C
DAC LOADED WITH FULLSCALE
V
REF
= 2V
±
0.3Vp-p
Figure 24. Total Harmonic Distortion
CAPACITANCE (nF)
T
μ
S
16
14
12
10
8
6
4
0
1
2
3
4
5
6
7
9
8
10
0
V
REF
= V
DD
T
A
= 25
°
C
V
DD =
5V
V
DD =
3V
Figure 25. Settling Time vs. Capacitive Load
0
1
Y AXIS = 2
μ
V/DIV
X AXIS = 4s/DIV
V
DD
= V
REF
= 5V
T
= 25
°
DAC LOADED WITH MIDSCALE
Figure 26. 0.1 Hz to 10 Hz Output Noise Plot
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PDF描述
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