V
參數(shù)資料
型號(hào)： AD5173BRM10-RL7
廠商： Analog Devices Inc
文件頁數(shù)： 28/28頁
文件大?。?/td> 0K
描述： IC DGTL POT DUAL 10K OTP 10-MSOP
標(biāo)準(zhǔn)包裝： 1,000
接片： 256
電阻（歐姆）： 10k
電路數(shù)： 2
溫度系數(shù)： 標(biāo)準(zhǔn)值 35 ppm/°C
存儲(chǔ)器類型： 非易失
接口： I²C（設(shè)備位址）
電源電壓： 2.7 V ~ 5.5 V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 10-TFSOP，10-MSOP（0.118"，3.00mm 寬）
供應(yīng)商設(shè)備封裝： 10-MSOP
包裝： 帶卷 (TR)
Data Sheet
AD5172/AD5173
Rev. I | Page 9 of 28
PIN CONFIGURATIONS AND FUNCTION DESCRIPTIONS
B1
1
A1
2
W2
3
GND
4
VDD 5
W1
10
B2
9
A2
8
SDA
7
SCL
6
AD5172
TOP VIEW
(Not to Scale)
04103-
045
Figure 4. AD5172 Pin Configuration
Table 5. AD5172 Pin Function Descriptions
Pin
No.
Mnemonic
Description
1
B1
B1 Terminal. GND ≤ VB1 ≤ VDD.
2
A1
A1 Terminal. GND ≤ VA1 ≤ VDD.
3
W2
W2 Terminal. GND ≤ VW2 ≤ VDD.
4
GND
Digital Ground.
5
VDD
Positive Power Supply. Specified for
operation from 2.7 V to 5.5 V. For OTP
programming, VDD needs to be a minimum
of 5.6 V but no more than 5.8 V and to be
capable of driving 100 mA.
6
SCL
Serial Clock Input. Positive-edge triggered.
Requires a pull-up resistor. If this pin is driven
directly from a logic controller without a
pull-up resistor, ensure that the VIH minimum
is 0.7 V × VDD.
7
SDA
Serial Data Input/Output. Requires a pull-up
resistor. If this pin is driven directly from a
logic controller without a pull-up resistor,
ensure that the VIH minimum is 0.7 V × VDD.
8
A2
A2 Terminal. GND ≤ VA2 ≤ VDD.
9
B2
B2 Terminal. GND ≤ VB2 ≤ VDD.
10
W1
W1 Terminal. GND ≤ VW1 ≤ VDD.
B1
1
AD0
2
W2
3
GND
4
VDD 5
W1
10
B2
9
AD1
8
SDA
7
SCL
6
AD5173
TOP VIEW
(Not to Scale)
04103-
046
Figure 5. AD5173 Pin Configuration
Table 6. AD5173 Pin Function Descriptions
Pin
No.
Mnemonic
Description
1
B1
B1 Terminal. GND ≤ VB1 ≤ VDD.
2
AD0
Programmable Address Bit 0 for Multiple
Package Decoding.
3
W2
W2 Terminal. GND ≤ VW2 ≤ VDD.
4
GND
Digital Ground.
5
VDD
Positive Power Supply. Specified for
operation from 2.7 V to 5.5 V. For OTP
programming, VDD needs to be a minimum
of 5.6 V but no more than 5.8 V and to be
capable of driving 100 mA.
6
SCL
Serial Clock Input. Positive-edge triggered.
Requires a pull-up resistor. If this pin is driven
directly from a logic controller without a
pull-up resistor, ensure that the VIH minimum
is 0.7 V × VDD.
7
SDA
Serial Data Input/Output. Requires a pull-up
resistor. If this pin is driven directly from a
logic controller without a pull-up resistor,
ensure that the VIH minimum is 0.7 V × VDD.
8
AD1
Programmable Address Bit 1 for Multiple
Package Decoding.
9
B2
B2 Terminal. GND ≤ VB2 ≤ VDD.
10
W1
W1 Terminal. GND ≤ VW1 ≤ VDD.
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