參數(shù)資料
型號(hào)： A42MX16-FPQ100M
廠商： Electronic Theatre Controls, Inc.
英文描述： Octal Transparent D-Type Latches With 3-State Outputs 20-TSSOP -40 to 85
中文描述： 40MX和42MX FPGA系列
文件頁數(shù)： 44/123頁
文件大?。?/td> 854K
代理商： A42MX16-FPQ100M
40MX and 42MX FPGA Families
1-38
v6.0
TTL Output Module Timing
4
t
DLH
Data-to-Pad HIGH
3.3
3.8
4.3
5.1
7.2
ns
t
DHL
Data-to-Pad LOW
4.0
4.6
5.2
6.1
8.6
ns
t
ENZH
Enable Pad Z to
HIGH
3.7
4.3
4.9
5.8
8.0
ns
t
ENZL
Enable Pad Z to
LOW
4.7
5.4
6.1
7.2
10.1
ns
t
ENHZ
Enable Pad HIGH to
Z
7.9
9.1
10.4
12.2
17.1
ns
t
ENLZ
Enable Pad LOW to
Z
5.9
6.8
7.7
9.0
12.6
ns
d
TLH
Delta LOW to HIGH
0.02
0.02
0.03
0.03
0.04
ns/pF
d
THL
CMOS Output Module Timing
4
Delta HIGH to LOW
0.03
0.03
0.03
0.04
0.06
ns/pF
t
DLH
Data-to-Pad HIGH
3.9
4.5
5.1
6.05
8.5
ns
t
DHL
Data-to-Pad LOW
3.4
3.9
4.4
5.2
7.3
ns
t
ENZH
Enable Pad Z to
HIGH
3.4
3.9
4.4
5.2
7.3
ns
t
ENZL
Enable Pad Z to
LOW
4.9
5.6
6.4
7.5
10.5
ns
t
ENHZ
Enable Pad HIGH to
Z
7.9
9.1
10.4
12.2
17.0
ns
t
ENLZ
Enable Pad LOW to
Z
5.9
6.8
7.7
9.0
12.6
ns
d
TLH
Delta LOW to HIGH
0.03
0.04
0.04
0.05
0.07
ns/pF
d
THL
Delta HIGH to LOW
0.02
0.02
0.03
0.03
0.04
ns/pF
Table 28
A40MX02 Timing Characteristics (Nominal 5.0V Operation) (Continued)
(Worst-Case Commercial Conditions, V
CC
= 4.75V, T
J
= 70°C)
‘–3’ Speed
‘–2’ Speed
‘–1’ Speed
‘Std’ Speed
‘–F’ Speed
Units
Parameter Description
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Notes:
1. Routing delays are for typical designs across worst-case operating conditions. These parameters should be used for estimating
device performance. Post-route timing analysis or simulation is required to determine actual performance.
2. Set-up times assume fanout of 3. Further testing information can be obtained from the Timer utility.
3. The hold time for the DFME1A macro may be greater than 0 ns. Use the Timer tool from the Designer software to check the hold
time for this macro.
4. Delays based on 35pF loading.
相關(guān)PDF資料
PDF描述
A42MX16-FTQ100 Octal Transparent D-Type Latches With 3-State Outputs 20-TSSOP -40 to 85
A42MX16-FTQ100A Octal Transparent D-Type Latches With 3-State Outputs 20-TSSOP -40 to 85
A42MX16-FTQ100B Octal Transparent D-Type Latches With 3-State Outputs 20-TSSOP -40 to 85
A42MX16-FTQ100ES Octal Transparent D-Type Latches With 3-State Outputs 20-TSSOP -40 to 85
A42MX16-FTQ100I Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-SSOP -40 to 85
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參數(shù)描述
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A42MX16-FPQ160I 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA)
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A42MX16-FPQ208 功能描述:IC FPGA MX SGL CHIP 24K 208-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:MX 標(biāo)準(zhǔn)包裝:90 系列:ProASIC3 LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計(jì):36864 輸入/輸出數(shù):157 門數(shù):250000 電源電壓:1.425 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C 封裝/外殼:256-LBGA 供應(yīng)商設(shè)備封裝:256-FPBGA（17x17）
A42MX16-FPQ208I 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA)
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