2-68 Revision 11 Figure 2-36 FIFO FULL Flag and AFULL Flag Assertion Figure 2-37 FI" />
參數資料
型號： A3PN125-ZVQ100
廠商： Microsemi SoC
文件頁數： 96/114頁
文件大?。?/td> 0K
描述： IC FPGA NANO 125K GATES 100-VQFP
標準包裝： 90
系列： ProASIC3 nano
RAM 位總計： 36864
輸入/輸出數： 71
門數： 125000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 100-TQFP
供應商設備封裝： 100-VQFP（14x14）
ProASIC3 nano DC and Switching Characteristics
2-68
Revision 11
Figure 2-36 FIFO FULL Flag and AFULL Flag Assertion
Figure 2-37 FIFO EMPTY Flag and AEMPTY Flag Deassertion
Figure 2-38 FIFO FULL Flag and AFULL Flag Deassertion
NO MATCH
Dist = AFF_TH
MATCH (FULL)
tCKAF
tWCKFF
tCYC
WCLK
FULL
AFULL
WA/RA
(Address Counter)
WCLK
WA/RA
(Address Counter)
MATCH
(EMPTY)
NO MATCH
Dist = AEF_TH + 1
NO MATCH
RCLK
EMPTY
1st Rising
Edge
After 1st
Write
2nd Rising
Edge
After 1st
Write
tRCKEF
tCKAF
AEMPTY
Dist = AFF_TH – 1
MATCH (FULL)
NO MATCH
tWCKF
tCKAF
1st Rising
Edge
After 1st
Read
1st Rising
Edge
After 2nd
Read
RCLK
WA/RA
(Address Counter)
WCLK
FULL
AFULL
相關PDF資料
PDF描述
A3PN125-ZVQG100 IC FPGA NANO 125K GATES 100-VQFP
AGLN060V5-VQ100 IC FPGA NANO 1KB 60K 100VQFP
HCC65DRXI-S734 CONN EDGECARD 130PS DIP .100 SLD
ESC65DRYS CONN EDGECARD 130PS DIP .100 SLD
ACC49DREN CONN EDGECARD 98POS .100 EYELET
相關代理商/技術參數
參數描述
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