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參數(shù)資料
| 型號： | A3PN015-1QNG68I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 39/114頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA NANO 15K GATES 68-QFN |
| 標準包裝： | 260 |
| 系列： | ProASIC3 nano |
| 輸入/輸出數(shù)： | 49 |
| 門數(shù)： | 15000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 68-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 68-QFN（8x8） |
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ProASIC3 nano DC and Switching Characteristics
2-16
Revision 11
Overview of I/O Performance
Summary of I/O DC Input and Output Levels – Default I/O Software
Settings
Table 2-14 Summary of Maximum and Minimum DC Input and Output Levels
Applicable to Commercial and Industrial Conditions—Software Default Settings
I/O Standard
Drive
Strength
Equivalent
Software
Default
Drive
Strength
Option2
Slew
Rate
VIL
VIH
VOL
VOH
IOL1 IOH1
Min.
V
Max
V
Min.
V
Max.
V
Max. V
Min.
VmA mA
3.3 V LVTTL/
3.3 V
LVCMOS
8 mA
High –0.3
0.8
2
3.6
0.4
2.4
8
3.3 V
LVCMOS
Wide Range
100 A
8 mA
High –0.3
0.8
2
3.6
0.2
VCCI – 0.2 100
A
100
A
2.5 V
LVCMOS
8 mA
High –0.3
0.7
1.7
3.6
0.7
1.7
8
1.8 V
LVCMOS
4 mA
High –0.3 0.35 * VCCI 0.65 * VCCI 3.6
0.45
VCCI – 0.45
4
1.5 V
LVCMOS
2 mA
High –0.3 0.35 * VCCI 0.65 * VCCI 3.6 0.25 * VCCI 0.75 * VCCI
2
Notes:
1. Currents are measured at 85°C junction temperature.
2. The minimum drive strength for any LVCMOS 3.3 V software configuration when run in wide range is ±100 A. Drive
strength displayed in the software is supported for normal range only. For a detailed I/V curve, refer to the IBIS models.
3. All LVCMOS 3.3 V software macros support LVCMOS 3.3 V wide range, as specified in the JESD8-B specification.
Table 2-15 Summary of Maximum and Minimum DC Input Levels
Applicable to Commercial and Industrial Conditions
DC I/O Standards
Commercial 1
Industrial 2
IIL 3
IIH 4
IIL 3
IIH 4
A
3.3 V LVTTL / 3.3 V LVCMOS
10
15
3.3 V LVCMOS Wide Range
10
15
2.5 V LVCMOS
10
15
1.8 V LVCMOS
10
15
1.5 V LVCMOS
10
15
Notes:
1. Commercial range (–20°C < TA < 70°C)
2. Industrial range (–40°C < TA < 85°C)
3. IIL is the input leakage current per I/O pin over recommended operation conditions where –0.3 V < VIN < VIL.
4. IIH is the input leakage current per I/O pin over recommended operating conditions VIH < VIN < VCCI. Input current is
larger when operating outside recommended ranges.
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