Revision 11 2-47 Output DDR Module Figure 2-17 Output DDR Timing Model Table 2-63 Parameter Defin" />
參數(shù)資料
型號(hào)： A3PN010-2QNG48
廠商： Microsemi SoC
文件頁數(shù)： 73/114頁
文件大?。?/td> 0K
描述： IC FPGA NANO 10K GATES 48-QFN
標(biāo)準(zhǔn)包裝： 260
系列： ProASIC3 nano
輸入/輸出數(shù)： 34
門數(shù)： 10000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 48-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 48-QFN（6x6）
ProASIC3 nano Flash FPGAs
Revision 11
2-47
Output DDR Module
Figure 2-17 Output DDR Timing Model
Table 2-63 Parameter Definitions
Parameter Name
Parameter Definition
Measuring Nodes (from, to)
tDDROCLKQ
Clock-to-Out
B, E
tDDROCLR2Q
Asynchronous Clear-to-Out
C, E
tDDROREMCLR
Clear Removal
C, B
tDDRORECCLR
Clear Recovery
C, B
tDDROSUD1
Data Setup Data_F
A, B
tDDROSUD2
Data Setup Data_R
D, B
tDDROHD1
Data Hold Data_F
A, B
tDDROHD2
Data Hold Data_R
D, B
Data_F
(from core)
CLK
CLKBUF
Out
FF2
INBUF
CLR
DDR_OUT
Output DDR
FF1
0
1
X
A
B
D
E
C
B
OUTBUF
Data_R
(from core)
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PDF描述
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A3PN010-1QNG48 IC FPGA NANO 10K GATES 48-QFN
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參數(shù)描述
A3PN010-2QNG48I 功能描述:IC FPGA NANO 10K GATES 48-QFN RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:ProASIC3 nano 標(biāo)準(zhǔn)包裝:152 系列:IGLOO PLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):792 RAM 位總計(jì):- 輸入/輸出數(shù):120 門數(shù):30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應(yīng)商設(shè)備封裝:289-CSP（14x14）
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