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參數(shù)資料
| 型號： | A1020B-VQG80I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 7/98頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 2K GATES 80-VQFP IND |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | ACT™ 1 |
| LAB/CLB數(shù)： | 547 |
| 輸入/輸出數(shù)： | 69 |
| 門數(shù)： | 2000 |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 80-TQFP |
| 供應(yīng)商設(shè)備封裝： | 80-VQFP（14x14） |
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Hi R e l F P GA s
3 200 DX T i m i n g Mo de l ( L ogi c Fu nct i o ns u s i n g Qu ad ra nt Cl oc ks ) *
* Values shown for A32100DX–1 at worst-case military conditions.
** Load dependent.
Output Delays
Internal Delays
Input Delays
tINH = 0.0 ns
tINSU = 0.7 ns
I/O Module
D
Q
tINGO = 4.0 ns
tINPY = 1.9 ns t
IRD1 = 2.2 ns
Combinatorial
Module
tPD = 3.1 ns
Sequential
Logic Module
I/O Module
tRD1 = 1.3 ns
tDLH = 6.3 ns
I/O Module
QUADRANT
CLOCKS
FMAX = 100 MHz
Combin-
atorial
Logic
included
in tSUD
D
Q
D
Q
tLH = 0.0 ns
tLSU = 0.4 ns
tGHL= 12.4 ns
tDLH = 6.3 ns
tENHZ = 11.5 ns
tRD1 = 1.3 ns
tCO = 3.1 ns
tSU = 0.5 ns
tHD = 0.0 ns
Predicted
Routing
Delays
G
Decode
Module
tPDD = 3.3 ns
tRDD = 0.5 ns
tRD2 = 1.9 ns
tRD4 = 3.3 ns
tCKH = 12 ns**
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A1020B-VQ80I | IC FPGA 2K GATES 80-VQFP IND |
| A54SX16P-2VQG100I | IC FPGA SX 24K GATES 100-VQFP |
| 10350-32J0-000 | JUNCTION SHELL 50POS BIEGE |
| 10380-3280-000-1 | JUNCTION SHELL PLASTIC 80POS |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| A1020-CQ84B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A1020-CQ84C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A1020-CQ84I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A1020-CQ84M | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A1020-JQ44B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
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