參數(shù)資料
型號(hào)： 74LVT573
廠商： Fairchild Semiconductor Corporation
英文描述： Low Voltage Octal Transparent Latch with 3-STATE Outputs
中文描述： 低壓八路透明鎖存器與三態(tài)輸出
文件頁(yè)數(shù)： 7/12頁(yè)
文件大?。?/td> 99K
代理商： 74LVT573
Philips Semiconductors
Product specification
74LVT573
3.3V Octal D-type transparent latch
(3-State)
1998 Feb 19
7
OE
t
PZH
t
PHZ
0V
V
OH
–0.3V
Qn
1.5V
1.5V
1.5V
2.7V
0V
V
OH
SV00119
Waveform 4. 3-State Output Enable Time to High Level and
Output Disable Time from High Level
OE
t
PZL
t
PLZ
V
OL
+0.3V
Qn
1.5V
1.5V
1.5V
2.7V
0V
V
OL
3V
SV00120
Waveform 5. 3-State Output Enable Time to Low Level and
Output Disable Time from Low Level
TEST CIRCUIT AND WAVEFORM
V
M
V
M
t
W
AMP (V)
NEGATIVE
PULSE
10%
10%
90%
90%
0V
V
M
V
M
t
W
AMP (V)
POSITIVE
PULSE
90%
90%
10%
10%
0V
t
THL
(t
F
)
t
TLH
(t
R
)
t
THL
(t
F
)
t
TLH
(t
R
)
V
= 1.5V
Input Pulse Definition
DEFINITIONS
R
L
=
Load resistor; see AC CHARACTERISTICS for value.
C
L
=
Load capacitance includes jig and probe capacitance;
see AC CHARACTERISTICS for value.
R
T
=
Termination resistance should be equal to Z
OUT
of
pulse generators.
INPUT PULSE REQUIREMENTS
FAMILY
74LVT
PULSE
GENERATOR
V
IN
D.U.T.
V
OUT
C
L
V
CC
R
L
Test Circuit for 3-State Outputs
6.0V
R
T
R
L
SV00092
Open
GND
SWITCH POSITION
TEST
SWITCH
t
PLH
/t
PHL
t
PLZ
/t
PZL
t
PHZ
/t
PZH
Open
6V
GND
Amplitude
Rep. Rate
t
W
t
R
t
F
2.7V
10MHz
500ns
2.5ns
2.5ns
相關(guān)PDF資料
PDF描述
74LVT573MSA Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-SO -40 to 85
74LVT573MSAX Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-TSSOP -40 to 85
74LVT573MTC Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-TSSOP -40 to 85
74LVT573MTCX Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-TSSOP -40 to 85
74LVT573SJ Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-TSSOP -40 to 85
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