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參數(shù)資料
| 型號： | 74LVC574APW,112 |
| 廠商： | NXP Semiconductors |
| 文件頁數(shù)： | 19/19頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC OCT D FF POS-EDG TRIG 20TSSOP |
| 產(chǎn)品培訓(xùn)模塊： | Logic Packages |
| 標(biāo)準(zhǔn)包裝： | 1,875 |
| 系列： | 74LVC |
| 功能： | 標(biāo)準(zhǔn) |
| 類型： | D 型總線 |
| 輸出類型： | 三態(tài)非反相 |
| 元件數(shù)： | 1 |
| 每個元件的位元數(shù)： | 8 |
| 延遲時間 - 傳輸： | 9ns |
| 觸發(fā)器類型： | 正邊沿 |
| 輸出電流高，低： | 24mA，24mA |
| 電源電壓： | 1.2 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 包裝： | 管件 |
74LVC574A
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NXP B.V. 2012. All rights reserved.
Product data sheet
Rev. 5 — 18 December 2012
9 of 19
NXP Semiconductors
74LVC574A
Octal D-type flip-flop; 5 V tolerance; positive edge-trigger; 3-state
11. AC waveforms
Measurement points are given in Table 8.
VOL and VOH are typical output voltage levels that occur with the output load.
Fig 7.
Clock (CP) to output (Qn) propagation delays, the clock pulse width, output transition times, and the
maximum frequency
mna802
CP input
Qn output
tPHL
tPLH
tW
1/fmax
VM
VOH
VI
GND
VOL
VM
Measurement points are given in Table 8.
VOL and VOH are typical output voltage levels that occur with the output load.
The shaded areas indicate when the input is permitted to change for predictable output performance.
Fig 8.
Data set-up and hold times for the Dn input to the CP input
mna803
GND
th
tsu
th
tsu
VM
VI
VOH
VOL
VI
Qn output
CP input
Dn input
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PDF描述 |
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參數(shù)描述 |
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