參數(shù)資料
型號(hào)： 74LV164
廠商： NXP Semiconductors N.V.
英文描述： 8-bit serial-in/parallel-out shift register(8位串入并出移位寄存器)
中文描述： 8位serial-in/parallel-out移位寄存器（8位串入并出移位寄存器）
文件頁(yè)數(shù)： 7/12頁(yè)
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代理商： 74LV164
Philips Semiconductors
Product specification
74LV164
8-bit serial-in/parallel-out shift register
1998 May 07
7
AC WAVEFORMS
V
M
= 1.5V at V
CC
V
M
= 0.5V * V
CC
at V
CC
V
and V
OH
are the typical output voltage drop that occur with the
output load.
2.7V
3.6V
2.7V and
4.5V
t
PLH
t
PHL
1/f
max
V
OH
Q
n
OUTPUT
V
I
CP INPUT
GND
V
OL
V
M
V
M
t
w
SV00351
Figure 1. The clock (CP) to output (Q
n
) propagation delays, the
clock pulse width, the output transition times and the
maximum clock pulse frequency
Vi
V
OL
V
M
t
w
t
rem
t
PHL
V
M
Q
n
OUTPUT
CP INPUT
GND
V
OH
MR INPUT
Vi
GND
SV00352
V
M
Figure 2. The master reset (MR) pulse width, the master reset to
output (Q
n
) propagation delay and the master reset to clock
(CP) removal time
tsu
tsu
CP INPUT
D
n
INPUT
Q
n
OUTPUT
V
M
V
M
V
M
V
l
GND
V
l
GND
V
OH
V
OL
SV00353
Figure 3. Data set-up and hold times for the D
n
inputs
NOTE:
The shaded areas indicate when the input is permitted to change for
predictable output performance.
TEST CIRCUIT
PULSE
GENERATOR
R
T
V
l
D.U.T.
V
O
C
L
R
L
= 1k
V
cc
Test Circuit for Outputs
DEFINITIONS
R
L
= Load resistor
C
L
= Load capacitance includes jig and probe capacitiance
R
T
= Termination resistance should be equal to Z
OUT
of pulse generators.
V
CC
V
I
< 2.7V
2.7–3.6V
V
CC
2.7V
TEST
t
PLH/
t
PHL
≥
4.5 V
V
CC
50pF
SV00902
Figure 4. Load circuitry for switching times
相關(guān)PDF資料
PDF描述
74LV164PWDH 8-bit serial-in/parallel-out shift register
74LV165A 8-bit parallel-in/serial-out shift register
74LV165PWDH 8-bit parallel-in/serial-out shift register
74LV165 8-bit parallel-in/serial-out shift register(8位并入串出移位寄存器)
74LV174 Hex D-type flip-flop with reset;positive-edge trigger(上升沿觸發(fā),帶復(fù)位的六D觸發(fā)器)
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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