參數(shù)資料
型號： 5962G9655501VCC
元件分類： 計數(shù)器
英文描述： ACT SERIES, SYN POSITIVE EDGE TRIGGERED 4-BIT UP BINARY COUNTER, CDIP16
封裝： SIDE-BRAZED, CERAMIC, DIP-16
文件頁數(shù)： 7/10頁
文件大小： 249K
代理商： 5962G9655501VCC
6
AC ELECTRICAL CHARACTERISTICS 2
(VDD = 5.0V ±10%; VSS = 0V
1, -55
°C < T
C < +125°C); Unless otherwise noted, Tc is per the temperature range ordered.
Notes:
1. Maximum allowable relative shift equals 50mV.
2. All specifications valid for radiation dose
≤ 1E6 rads(Si).
3. Based on characterization, hold time (tH1) of 0ns can be assumed if data setup time (tSU1) is >10ns. This is guaranteed, but not tested.
SYMBOL
PARAMETER
MINIMUM
MAXIMUM
UNIT
tPHL
CLK to Qn
4
24
ns
tPLH
CLK to Qn
4
22
ns
tPHL
CLK to RCO
4
22
ns
tPLH
CLK to RCO
4
24
ns
tPHL
ENT to RCO
1
13
ns
tPLH
ENT to RCO
1
14
ns
fMAX
Maximum clock frequency
77
MHz
tSU1
A, B, C, D
Setup time before CLK
↑
6
ns
tSU2
LOAD, ENP, ENT, CLR low or high
Setup time before CLK
↑
6
ns
tH1
3
Data hold time after CLK
↑
1
ns
tH2
All synchronous inputs hold time after CLK
↑
1
ns
tW
Minimum pulse width
CLR low
CLK high
CLK low
7
ns
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PDF描述
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