參數(shù)資料
型號(hào)： 2SK4092-A
廠商： NEC Corp.
英文描述： SWITCHING N-CHANNEL POWER MOS FET
中文描述： 開關(guān)N溝道功率場(chǎng)效應(yīng)晶體管
文件頁數(shù)： 2/8頁
文件大?。?/td> 196K
代理商： 2SK4092-A
Data Sheet D18776EJ1V0DS
2
2SK4092
ELECTRICAL CHARACTERISTICS (T
A
= 25
°
C)
CHARACTERISTICS
SYMBOL
TEST CONDITIONS
MIN.
TYP.
MAX. UNIT
Zero Gate Voltage Drain Current
I
DSS
V
DS
= 600 V, V
GS
= 0 V
10
μ
A
Gate Leakage Current
I
GSS
V
GS
=
±
30 V, V
DS
= 0 V
±
100
nA
Gate to Source Cut-off Voltage
V
GS(off)
V
DS
= 10 V, I
D
= 1 mA
2.5
3.0
3.5
V
Forward Transfer Admittance
Note
| y
fs
|
V
DS
= 10 V, I
D
= 10 A
4.0
S
Drain to Source On-state Resistance
Note
R
DS(on)
V
GS
= 10 V, I
D
= 10 A
0.34
0.4
Ω
Input Capacitance
C
iss
V
DS
= 10 V,
3240
pF
Output Capacitance
C
oss
V
GS
= 0 V,
550
pF
Reverse Transfer Capacitance
C
rss
f = 1 MHz
3
pF
Turn-on Delay Time
t
d(on)
V
DD
= 150 V, I
D
= 10 A,
38
ns
Rise Time
t
r
V
GS
= 10 V,
15
ns
Turn-off Delay Time
t
d(off)
R
G
= 10
Ω
58
ns
Fall Time
t
f
12
ns
Total Gate Charge
Q
G
50
nC
Gate to Source Charge
Q
GS
24
nC
Gate to Drain Charge
Q
GD
V
DD
= 450 V,
V
GS
= 10 V,
I
D
= 21 A
17
nC
Body Diode Forward Voltage
Note
V
F(S-D)
I
F
= 21 A, V
GS
= 0 V
0.9
1.5
V
Reverse Recovery Time
t
rr
I
F
= 21 A, V
GS
= 0 V,
480
ns
Reverse Recovery Charge
Q
rr
di/dt = 100 A/
μ
s
6000
nC
Note
Pulsed
TEST CIRCUIT 1 AVALANCHE CAPABILITY
R
G
= 25
Ω
50
Ω
PG.
L
V
DD
V
GS
= 20
→
0 V
BV
DSS
I
AS
I
D
V
DS
Starting T
ch
V
DD
D.U.T.
TEST CIRCUIT 3 GATE CHARGE
TEST CIRCUIT 2 SWITCHING TIME
PG.
R
G
0
V
GS
D.U.T.
R
L
V
DD
τ
= 1 s
Duty Cycle
≤
1%
τ
PG.
50
Ω
D.U.T.
R
L
V
DD
I
G
= 2 mA
GS
Wave Form
DS
Wave Form
V
GS
V
DS
10%
0
0
90%
90%
90%
V
GS
V
DS
t
on
t
off
t
d(on)
t
r
t
d(off)
t
f
10%
10%
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