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參數(shù)資料
| 型號(hào)： | 20-668-0024 |
| 廠商： | Rabbit Semiconductor |
| 文件頁數(shù)： | 73/358頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CPU RABBIT4000 128-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | Rabbit 4000 |
| 處理器類型： | Rabbit 4000 8-位 |
| 速度： | 60MHz |
| 電壓： | 2.5V，2.7V，3V，3.3V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-LQFP |
| 供應(yīng)商設(shè)備封裝： | 128-LQFP（14x14） |
| 包裝： | 托盤 |
| 其它名稱： | 20-668-0022 316-1078 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁當(dāng)前第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁第311頁第312頁第313頁第314頁第315頁第316頁第317頁第318頁第319頁第320頁第321頁第322頁第323頁第324頁第325頁第326頁第327頁第328頁第329頁第330頁第331頁第332頁第333頁第334頁第335頁第336頁第337頁第338頁第339頁第340頁第341頁第342頁第343頁第344頁第345頁第346頁第347頁第348頁第349頁第350頁第351頁第352頁第353頁第354頁第355頁第356頁第357頁第358頁
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Rabbit 4000 Microprocessor User’s Manual
Figure 17-2 shows the adjustment ranges and output clock for the different modes of
operation of the DPLL. Each mode of operation will be described in turn.
Figure 17-2. Adjustment Ranges and Output Clock for Different DPLL Modes
With NRZ and NRZI encoding, all transitions occur on bit-cell boundaries and the data
should be sampled in the middle of the bit cell. If a transition occurs after the expected bit-
cell boundary (but before the midpoint), the DPLL needs to lengthen the count to line up
the bit-cell boundaries. This corresponds to the “add one” and “add two” regions shown. If
a transition occurs before the bit-cell boundary (but after the midpoint), the DPLL needs to
shorten the count to line up the bit-cell boundaries. This corresponds to the “subtract one”
and “subtract two” regions shown. The DPLL makes no adjustment if the bit-cell boundaries
are lined up within one count of the divide-by-16 counter. The regions that adjust the
count by two allow the DPLL to synchronize faster to the data stream when starting up.
With biphase-level encoding, there is a guaranteed “clock” transition at the center of every
bit cell and optional “data” transitions occur at the bit cell boundaries. The DPLL only
uses the clock transitions to track the bit-cell boundaries by ignoring all transitions occur-
ring outside a window around the center of the bit cell. This window is half a bit cell wide.
Additionally, because the clock transitions are guaranteed, the DPLL requires that they
always be present. If no transition is found in the window around the center of the bit cell
for two successive bit cells, the DPLL is not in lock and immediately enters the search
mode. The search mode assumes that the next transition seen is a clock transition and
immediately synchronizes to this transition. No clock output is provided to the receiver
during the search operation. Decoding biphase-level data requires that the data be sampled
at either the quarter or three-quarter point in the bit cell. The DPLL here uses the quarter
point to sample the data.
BIT CELL
NRZI adj
NRZI CLOCK
BIPHASE LEVEL adj
BIPHASE LEVEL CLOCK
BIPHASE SPACE adj
BIPHASE SPACE CLOCK
BIPHASE MARK adj
BIPHASE MARK CLOCK
NONE ADD ONE
ADD TWO
SUBTRACT
TWO
SUBTRACT
ONE
NONE
IGNORE
TRANSITIONS
SUBTRACT
ONE
NONE ADD ONE
IGNORE
TRANSITIONS
NONE ADD ONE
SUBTRACT
ONE
NONE
IGNORE
TRANSITIONS
NONE ADD ONE
SUBTRACT
ONE
NONE
IGNORE
TRANSITIONS
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