參數(shù)資料
型號： μPD78P014B
廠商： NEC Corp.
元件分類： 8位微控制器
英文描述： 8 Bit Single Chip Microcontrollers
中文描述： 8位單片機微控制器
文件頁數(shù)： 85/194頁
文件大?。?/td> 863K
代理商： ΜPD78P014B
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66
CHAPTER 4 INSTRUCTION SET
BCD
ADJBA
2
4
–
Decimal Adjust Accumulator after Addition
×
×
×
Adjust
ADJBS
2
4
–
Decimal Adjust Accumulator after Subtract
×
×
×
Bit
MOV1
CY,saddr.bit
3
6
7
CY
←
(saddr.bit)
×
Manipulation
CY,sfr.bit
3
–
7
CY
←
sfr.bit
×
CY,A.bit
2
4
–
CY
←
A.bit
×
CY,PSW.bit
3
–
7
CY
←
PSW.bit
×
CY,[HL].bit
2
6
7+n
CY
←
(HL).bit
×
saddr.bit,CY
3
6
8
(saddr.bit)
←
CY
sfr.bit,CY
3
–
8
sfr.bit
←
CY
A.bit,CY
2
4
–
A.bit
←
CY
PSW.bit,CY
3
–
8
PSW.bit
←
CY
×
×
[HL].bit,CY
2
6
8+n+m
(HL).bit
←
CY
AND1
CY,saddr.bit
3
6
7
CY
←
CY
∧
(saddr.bit)
×
CY,sfr.bit
3
–
7
CY
←
CY
∧
sfr.bit
×
CY,A.bit
2
4
–
CY
←
CY
∧
A.bit
×
CY,PSW.bit
3
–
7
CY
←
CY
∧
PSW.bit
×
CY,[HL].bit
2
6
7+n
CY
←
CY
∧
(HL).bit
×
OR1
CY,saddr.bit
3
6
7
CY
←
CY
∨
(saddr.bit)
×
CY,sfr.bit
3
–
7
CY
←
CY
∨
sfr.bit
×
CY,A.bit
2
4
–
CY
←
CY
∨
A.bit
×
CY,PSW.bit
3
–
7
CY
←
CY
∨
PSW.bit
×
CY,[HL].bit
2
6
7+n
CY
←
CY
∨
(HL).bit
×
XOR1
CY,saddr.bit
3
6
7
CY
←
CY
∨
(saddr.bit)
×
CY,sfr.bit
3
–
7
CY
←
CY
∨
sfr.bit
×
CY,A.bit
2
4
–
CY
←
CY
∨
A.bit
×
CY,PSW.bit
3
–
7
CY
←
CY
∨
PSW.bit
×
CY,[HL].bit
2
6
7+n
CY
←
CY
∨
(HL).bit
×
Notes 1.
When the internal high-speed RAM area is accessed or in the instruction with no data access.
When an area except the internal high-speed RAM area is accessed.
2.
Remarks 1.
1 instruction clock cycle is 1 CPU clock cycle (f
CPU
) selected by the processor clock control register
(PCC).
Number of clock cycles is when there is a program in the internal ROM area.
n indicates the number of waits when the external memory expansion area is read.
m indicates the number of waits when the external memory expansion area is written to.
2.
3.
4.
Instruction
Group
Clock
Flag
Mnemonic
Operands
Byte
Operation
Note 1
Note 2
Z AC CY
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PDF描述
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