參數(shù)資料
型號： μPD78P014B
廠商： NEC Corp.
元件分類： 8位微控制器
英文描述： 8 Bit Single Chip Microcontrollers
中文描述： 8位單片機微控制器
文件頁數(shù)： 77/194頁
文件大?。?/td> 863K
代理商： ΜPD78P014B
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58
CHAPTER 4 INSTRUCTION SET
Bit
AND1
CY,saddr.bit
3
6
7
CY
←
CY
∧
(saddr.bit)
×
Manipulation
CY,sfr.bit
3
–
7
CY
←
CY
∧
sfr.bit
×
CY,A.bit
2
4
–
CY
←
CY
∧
A.bit
×
CY,PSW.bit
3
–
7
CY
←
CY
∧
PSW.bit
×
CY,[HL].bit
2
6
7
CY
←
CY
∧
(HL).bit
×
OR1
CY,saddr.bit
3
6
7
CY
←
CY
∨
(saddr.bit)
×
CY,sfr.bit
3
–
7
CY
←
CY
∨
sfr.bit
×
CY,A.bit
2
4
–
CY
←
CY
∨
A.bit
×
CY,PSW.bit
3
–
7
CY
←
CY
∨
PSW.bit
×
CY,[HL].bit
2
6
7
CY
←
CY
∨
(HL).bit
×
XOR1
CY,saddr.bit
3
6
7
CY
←
CY
∨
(saddr.bit)
×
CY,sfr.bit
3
–
7
CY
←
CY
∨
sfr.bit
×
CY,A.bit
2
4
–
CY
←
CY
∨
A.bit
×
CY,PSW.bit
3
–
7
CY
←
CY
∨
PSW.bit
×
CY,[HL].bit
2
6
7
CY
←
CY
∨
(HL).bit
×
SET1
saddr.bit
2
4
6
(saddr.bit)
←
1
sfr.bit
3
–
8
sfr.bit
←
1
A.bit
2
4
–
A.bit
←
1
PSW.bit
2
–
6
PSW.bit
←
1
×
×
×
[HL].bit
2
6
8
(HL).bit
←
1
CLR1
saddr.bit
2
4
6
(saddr.bit)
←
0
sfr.bit
3
–
8
sfr.bit
←
0
A.bit
2
4
–
A.bit
←
0
PSW.bit
2
–
6
PSW.bit
←
0
×
×
×
[HL].bit
2
6
8
(HL).bit
←
0
SET1
CY
1
2
–
CY
←
1
1
CLR1
CY
1
2
–
CY
←
0
0
NOT1
CY
1
2
–
CY
←
CY
×
Notes 1.
When the internal high-speed RAM area is accessed or in the instruction with no data access.
When an area except the internal high-speed RAM area is accessed.
2.
Remark
1 instruction clock cycle is 1 CPU clock cycle (f
CPU
) selected by the processor clock control register
(PCC).
Instruction
Group
Clock
Flag
Mnemonic
Operands
Byte
Operation
Note 1
Note 2
Z AC CY
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PDF描述
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