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參數(shù)資料
| 型號： | ZPSD501B1-C-90JI |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Low Cost Field Programmable Microcontroller Peripherals |
| 中文描述： | 低成本現(xiàn)場可編程微控制器外圍設(shè)備 |
| 文件頁數(shù)： | 107/153頁 |
| 文件大?。?/td> | 1036K |
| 代理商： | ZPSD501B1-C-90JI |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁當(dāng)前第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁
PSD5XX Famly
104
12.0
System
Configuration
The CSIOP signal, which is generated by the DPLD, selects the internal I/O devices or
registers. The CSIOP signal takes up 256 bytes of address space and is defined by the user
in the PSDSoft Software. The following is an address offset map for the various devices
relative to the CSIOP base address.
Some Motorola 16-bit microcontrollers have a different data bus/data byte orientation. This
requires a different address offset for the internal PSD5XX I/O devices or registers. Tables
30a and 31a in this section are for this group of microcontrollers which include the
M68HC16, M68302 and M683XX.
The following table is the address map offset of the I/O port registers.
Address Ofset
Port B
Register Name
Port A
Port C
Port D
Port E
Data In
00
01
10
11
20
Control
02
03
12
13
22
Data Out
04
05
14
15
24
Direction
06
07
16
17
26
Open Drain
18
19
Special Function
08
09
28
PLD – I/O
0A
0B
2A
Macrocell Out
0C
0D
2C
Table 30. I/ORegister Address Ofset
Address Ofset
Port B
Register Name
Port A
Port C
Port D
Port E
Data In
01
00
11
10
21
Control
03
02
13
12
23
Data Out
05
04
15
14
25
Direction
07
06
17
16
27
Open Drain
19
18
Special Function
09
08
29
PLD – I/O
0B
0A
2B
Macrocell Out
0D
0C
2D
Table 30a. I/ORegister Address Ofset
(For 16-Bit Motorola MCUs in 16-Bit Mode. If 8-Bit Mode is selected, use Table 30.)
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PDF描述 |
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