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參數(shù)資料
| 型號： | ZPSD413A2-C-70L |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | TVS UNI-DIR 15V 600W DO-15 |
| 中文描述： | 低成本現(xiàn)場可編程微控制器外圍設(shè)備 |
| 文件頁數(shù)： | 71/123頁 |
| 文件大?。?/td> | 657K |
| 代理商： | ZPSD413A2-C-70L |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁當(dāng)前第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁
PSD4XX Famly
68
CLR
CLK
APD
COUNTER
APD CLK
PMMR1 - BIT 0
TO OTHER
CIRCUITS
MUX
APD
CLEAR
LOGIC
APD ENABLE
PMMR0 - BIT 2
ALE POLARITY
PMMR0 - BIT 1
ALE
RESET
APD CLK
CLKIN
CSI
SLEEP–ENABLE
PMMR1 - BIT 1
SLEEP
MODE
EPROM
SELECT
SRAM
SELECT
I/O
SELECT
POWER
DOWN
PD
Z
P
L
D
Figure 36. Power Management Unit
Figure 36a. Automatic Power Down Unit (APD) Flow Chart
APD DISABLED
NEED
APD CLK
YES
YES
NO
NO
RESET
SET APD CLK IN PMMR1 BIT 0
SET ALE PD POLARITY
IN PMMRO BIT 1
CSI = "1"
NEED
SLEEP
MODE
SET SLEEP MODE IN PMMR1 BIT 1
ALE IDLE and
15 APD CLOCK
ALE IDLE and
15 APD CLOCK
SET ENABLE APD IN PMMR0 BIT 2
SET PMMR0 BIT 0
SET ENABLE APD IN PMMR0 BIT 2
SET PMMR0 BIT 0
DISABLE CLOCKS
ZPLD ACLK, ZPLD RCLK, TMR ZPLD
DISABLE CLOCKS
ZPLD ACLK, ZPLD RCLK, TMR ZPLD
PSD IN POWER DOWN MODE
PSD IN SLEEP MODE
The PSD4XX
Architecture
(cont.)
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PDF描述 |
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