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參數資料
| 型號： | ZPSD401A2-90UI |
| 英文描述： | Field-Programmable Peripheral |
| 中文描述： | 現場可編程外圍 |
| 文件頁數： | 85/123頁 |
| 文件大小： | 657K |
| 代理商： | ZPSD401A2-90UI |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁當前第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁
PSD4XX Famly
82
-70
-90**
-15
ZPLD_TURBO
OFF
*
Symbol
Parameter
Conditions
Min Max
Min Max
Min Max
Unit
I/O Input or Feedback to
Combinatorial Output
t
PD
Port B, E
25
30
34
Add 10
ns
t
RPD
Registered Input to
Combinatorial Output
(Note 1)
27
32
36
Add 10
ns
t
EA
Input to Output Enable
Any Input
25
28
32
Add 10
ns
t
ER
Input to Output Disable
Any Input
25
28
32
Add 10
ns
t
ARP
Register Clear or Preset
Delay
Any Input
27
30
34
Add 10
ns
t
ARPW
Register Clear or Preset
Pulse Width
Any Input
20
25
29
ns
t
ARD
Array Delay
16
18
22
ns
Combinatorial Delays
(5 V ± 10% Versions)
NOTE:
1. Port A and latched address from ADIO (A0, A1, A8 – A15).
*
*
If ZPLD_TURBO is off and the ZPLD is operating above 15 MHz, there is no need to add 10 ns to the timing parameters.
**
The -90 speed is available only on Industrial Temperature Range product.
13.7 AC/DC Parameters – ZPLDTimng Parameters
(5 V ± 10% Versions)
-70
-90**
-15
ZPLD_TURBO
OFF
*
Symbol
Parameter
Conditions
Min
Max
Min
Max
Min
Max
Unit
Maximum Frequency
External Feedback
1/(t
S
+ t
CO
)
30.30
27.03
23.81
MHz
Maximum Frequency
Internal Feedback (f
CNT
)
f
MAX
1/(t
S
+t
CO
–10)
43.48
37.04
31.25
MHz
Maximum Frequency
Pipelined Data
1/(t
CH
+ t
CL
)
50.00
41.67
33.33
MHz
t
S
Input Setup Time
Any Input
15
17
20
Add 10
ns
t
H
Input Hold Time
Any Input
0
0
0
0
ns
t
CH
Clock High Time
Clock Input
10
12
15
0
ns
t
CL
Clock Low Time
Clock Input
10
12
15
0
ns
t
CO
Clock to Output Delay
Clock Input
18
20
22
0
ns
t
ARD
Array Delay for Product
Term Expansion
Any Macrocell
16
18
22
0
ns
t
MIN
Minimum Clock Period
t
CH
+ t
CL
20
24
29
0
ns
Synchronous Clock Mode
(5 V ± 10%)
*
*
If ZPLD_TURBO is off and the ZPLD is operating above 15 MHz, there is no need to add 10 ns to the timing parameters.
**
The -90 speed is available only on Industrial Temperature Range product.
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
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| ZPSD401A2-C-70L | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:Low Cost Field Programmable Microcontroller Peripherals |
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