參數資料
型號: ZPSD311
英文描述: Field Programmable Microcontroller Peripherals(可編程邏輯,零功耗,16K位SRAM,19個可編程I/O,通用PLD有12個輸入)
中文描述: 現(xiàn)場可編程微控制器外圍設備(可編程邏輯,零功耗,16K的位的SRAM,19余個可編程輸入/輸出,通用PLD的有12個輸入)
文件頁數: 30/90頁
文件大小: 491K
代理商: ZPSD311
ZPSD3XX Famly
3-30
Table 12a. Signal
States During
Power-Down
Mode
(ZPSD30X)
Table 13.
Internal States
During Power-
Down
Signal
Configuration Mode
Condition
Input
Unchanged
Input
All 1’s
Unchanged
All 1’s
Tri-stated
Input
All 1’s
AD0/A0–AD15/A15
All
I/O
Tracking AD0/A0–AD7/A7
Address outputs A0–A7
I/O
CS0–CS7 CMOS outputs
CS0–CS7 open drain outputs
Address inputs A18–A16
CS8–CS10 CMOS outputs
PA0–PA7
PB0–PB7
PC0–PC2
Component
Signals
Contents
CS0–CS10
CSADIN, CSADOUT1,
CSADOUT2, CSIOPORT,
RS0, ES0–ES7
n/a
n/a
n/a
n/a
All 1’s (deselected)
PAD
All 0’s (deselected)
Data register A
Direction register A
Data register B
Direction register B
All
unchanged
Signal
Configuration Mode
Condition
Input
Input
Unchanged
Input
All 1’s
Unchanged
All 1’s
Tri-stated
Input
All 1’s
AD0/A0–AD7/A7
A8–A15
All
All
I/O
Tracking AD0/A0–AD7/A7
Address outputs A0–A7
I/O
CS0–CS7 CMOS outputs
CS0–CS7 open drain outputs
Address inputs A18–A16
CS8–CS10 CMOS outputs
PA0–PA7
PB0–PB7
PC0–PC2
Table 12b.
Signal States
During Power-
Down Mode
(ZPSD31X)
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PDF描述
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參數描述
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