參數(shù)資料
型號： Z86E3116SEC
英文描述： Transient Surge Protection Thyristor; Package/Case:6-SOIC; Current, It av:2.2A; Reel Quantity:1500; Capacitance:20pF; Current Rating:2.2A; Forward Current:5A; Forward Voltage:640V; Holding Current:150mA; Mounting Type:Surface Mount
中文描述： 單片機| 8位| Z8的CPU |的CMOS |專科| 28腳|塑料
文件頁數(shù)： 18/64頁
文件大?。?/td> 310K
代理商： Z86E3116SEC
Z86E30/E31/E40
Z8 4K OTP Microcontroller
Zilog
18
P R E L I M I N A R Y
DS97Z8X0502
DC ELECTRICAL CHARACTERISTICS
(Continued)
T
A
= 0
°
C to 70
°
C
16 MHz
No
1
Symbol
Parameter
Note [3]
V
CC
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
3.5V
5.5V
Min
25
25
35
35
Max
Units
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Notes
2
TdA(AS)
Address Valid to AS Rise
Delay
AS Rise to Address Float
Delay
AS Rise to Read Data Req’d
Valid
AS Low Width
2
TdAS(A)
2
3
TdAS(DR)
180
180
1,2
4
TwAS
40
40
0
0
135
135
80
80
2
5
TdAS(DS)
Address Float to DS Fall
6
TwDSR
DS (Read) Low Width
1,2
7
TwDSW
DS (Write) Low Width
1,2
8
TdDSR(DR)
DS Fall to Read Data Req’d
Valid
Read Data to DS Rise Hold
Time
DS Rise to Address Active
Delay
DS Rise to AS Fall Delay
75
75
1,2
9
ThDR(DS)
0
0
2
10
TdDS(A)
50
50
35
35
25
25
35
35
55
55
35
35
2
11
TdDS(AS)
2
12
TdR/W(AS)
R/W Valid to AS Rise Delay
2
13
TdDS(R/W)
DS Rise to R/W Not Valid
2
14
TdDW(DSW)
Write Data Valid to DS Fall
(Write) Delay
DS Rise to Write Data Not
Valid Delay
Address Valid to Read Data
Req’d Valid
AS Rise to DS Fall Delay
25
25
2
15
TdDS(DW)
2
16
TdA(DR)
230
230
1,2
17
TdAS(DS)
45
45
30
30
35
35
2
18
TdDM(AS)
DM Valid to AS Fall Delay
2
20
ThDS(AS)
DS Valid to Address Valid
Hold Time
Notes:
1. When using extended memory timing, add 2 TpC.
2. Timing numbers given are for minimum TpC.
3. The V
CC
voltage specification of 5.5V guarantees 5.0V
±
0.5V and
the V
CC
voltage specification of 3.5V guarantees only 3.5V
Standard Test Load
All timing references use 0.7 V
CC
for a logic 1 and 0.2 V
CC
for a logic 0.
For Standard Mode (not Low-EMI Mode for outputs) with SMR D1 = 0, D0 = 0.
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