參數(shù)資料
型號(hào)： XRD9826ACUTR
廠商： Exar Corporation
文件頁(yè)數(shù)： 14/33頁(yè)
文件大小： 0K
描述： IC 16B CCD/CIS SIG PROC 20SSOP
產(chǎn)品變化通告： Leaded UART, V&I Obsolescence 11/Apr/2011
標(biāo)準(zhǔn)包裝： 1,500
位數(shù)： 16
通道數(shù)： 3
電壓 - 電源，模擬： 3V，5V
電壓 - 電源，數(shù)字： 3V，5V
封裝/外殼： 20-SSOP（0.209"，5.30mm 寬）
供應(yīng)商設(shè)備封裝： 20-SSOP
包裝： 帶卷 (TR)
XRD9826
21
Rev. 1.10
tdv
AREA, LINEAR or B/W CCD -- AC Coupled
(CLAMP Enabled)
Pixel N-1
Pixel N
Pixel N+1
CCD
Channel N
ADCCLK
tckpd
tap
tckhw
tcklw
CLAMP
tclpw
N-8
MSB
N-8
LSB
N-7
MSB
N-7
LSB
N-6
MSB
N-6
LSB
[5:0]
[11:6]
DB
Figure 15. Timing Diagram for Figure 14.
Triple Channel CCD Application
Figure 6 is a block diagram for pixel-by-pixel applica-
tions with triple channel CCDs. During the optically
shielded section of a pixel, CLAMP must go high to
store the black reference on each capacitor to the input.
The gain and offset is automatically rotated to adjust for
each channel input. The MSBs (8 upper bits) are
available on the output bus on the falling edge of
ADCCLK. The LSBs (8 lower bits) are available on the
rising edge of ADCCLK.
Note: There is an 8 clock latency at the output.
相關(guān)PDF資料
PDF描述
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