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參數(shù)資料
| 型號(hào)： | XR16M580IM48-F |
| 廠商： | Exar Corporation |
| 文件頁(yè)數(shù)： | 54/56頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC UART FIFO 16B 48TQFP |
| 標(biāo)準(zhǔn)包裝： | 250 |
| 特點(diǎn)： | * |
| 通道數(shù)： | 1，UART |
| FIFO's： | 16 字節(jié) |
| 規(guī)程： | RS232，RS422，RS485 |
| 電源電壓： | 1.62 V ~ 3.63 V |
| 帶自動(dòng)流量控制功能： | 是 |
| 帶IrDA 編碼器/解碼器： | 是 |
| 帶故障啟動(dòng)位檢測(cè)功能： | 是 |
| 帶調(diào)制解調(diào)器控制功能： | 是 |
| 帶CMOS： | 是 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-TQFP |
| 供應(yīng)商設(shè)備封裝： | 48-TQFP（7x7） |
| 包裝： | 托盤 |
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XR16M580
7
REV. 1.0.0
1.62V TO 3.63V HIGH PERFORMANCE UART WITH 16-BYTE FIFO
2.0
FUNCTIONAL DESCRIPTIONS
2.1
CPU Interface
The CPU interface is 8 data bits wide with 3 address lines and control signals to execute data bus read and
write transactions. The M580 data interface supports the Intel and motorola compatible types of CPUs. No
clock (oscillator nor external clock) is required for a data bus transaction. Each bus cycle is asynchronous
using CS#, IOR# and IOW# or R/W# inputs. A typical data bus interconnection for Intel and Motorola mode is
shown in Figure 4.
FIGURE 4. XR16M580 TYPICAL INTEL/MOTOROLA DATA BUS INTERCONNECTIONS
VCC
A0
A1
A2
UART_CS#
IOR#
IOW#
CS#
IOR#
IOW#
UART_INT
INT
Intel Data Bus Interconnections
GND
UART_RESET
RESET
16/68#
RI#
CD#
DSR#
CTS#
RTS#
DTR#
RX
TX
PwrSave
D0
D1
D2
D3
D4
D5
D6
D7
D0
D1
D2
D3
D4
D5
D6
D7
A0
A1
A2
Serial Transceivers of
RS-232
RS-485
RS-422
Or Infrared
POWERSAVE
VCC
A0
A1
A2
UART_CS#
R/W#
D0
D1
D2
D3
D4
D5
D6
D7
A0
A1
A2
CS#
D0
D1
D2
D3
D4
D5
D6
D7
IOR#
IOW#
UART_IRQ#
INT
Motorola Data Bus Interconnections
GND
UART_RESET#
RESET
RI#
CD#
DSR#
CTS#
RTS#
DTR#
RX
TX
NC
16/68#
vcc
POWERSAVE
PwrSave
Serial Transceivers of
RS-232
RS-485
RS-422
Or Infrared
相關(guān)PDF資料 |
PDF描述 |
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| XR16M581IL24 | 制造商:EXAR 制造商全稱:EXAR 功能描述:1.62V TO 3.63V UART WITH 16-BYTE FIFO AND VLIO INTERFACE |
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