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參數(shù)資料
| 型號(hào)： | XPC823VR81B2T |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 31/70頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU POWERQUICC 81MHZ 256-PBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | MPC8xx |
| 處理器類型： | 32-位 MPC8xx PowerQUICC |
| 速度： | 81MHz |
| 電壓： | 1.8V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BGA |
| 供應(yīng)商設(shè)備封裝： | 256-PBGA（23x23） |
| 包裝： | 托盤 |
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MPC823 ELECTRICAL SPECIFICATIONS
37
Table 7. JTAG Timing
NUM
CHARACTERISTIC
25MHZ
40MHZ
50MHZ
UNIT
MIN
MAX
MIN
MAX
MIN
MAX
J82
TCK cycle time
100
100
100
ns
J83
TCK clock pulse width measured at 1.5V
40
40
40
ns
J84
TCK rise and fall times
0
10
0
10
0
10
ns
J85
TMS, TDI data setup time
555
ns
J86
TMS, TDI data hold time
25
25
25
ns
J87
TCK low to TDO data valid
27
27
27
ns
J88
TCK low to TDO data invalid
000
ns
J89
TCK low to TDO high impedance
20
20
20
ns
J90
TRST assert time
100
100
100
ns
J91
TRST setup time to TCK low
40
40
40
ns
J92
TCK falling edge to output valid
50
50
50
ns
J93
TCK falling edge to ouput valid out of high impedance
50
50
50
ns
J94
TCK falling edge to output high impedance
50
50
50
ns
J95
Boundary scan input valid to TCK rising edge
50
50
50
ns
J96
TCK rising edge to boundary scan input invalid
50
50
50
ns
Figure 33. JTAG Test Clock Input Timing Diagram
TCK
J84
J83
J82
J84
J83
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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