Table 3-4 shows a short description of the dif" />
參數(shù)資料
型號(hào)： XE8801AMI000WP
廠商： Semtech
文件頁(yè)數(shù)： 50/135頁(yè)
文件大小： 0K
描述： SENSING MACHINE WITH 16 + 10 BIT
標(biāo)準(zhǔn)包裝： 558
系列： XE880x
應(yīng)用： 感測(cè)機(jī)
核心處理器： Coolrisc816?
程序存儲(chǔ)器類型： 閃存（22 kB）
控制器系列： XE8000
RAM 容量： 512 x 8
接口： UART，USRT
輸入/輸出數(shù)： 24
電源電壓： 2.4 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 模具
包裝： 托盤
配用： XE8000MP-ND - PROG BOARD AND PROSTART2 CARD
其它名稱： Q2722595
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)當(dāng)前第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)
Semtech 2005
www.semtech.com
3-4
XE8801A – SX8801R
3.3
CPU instruction short reference
Table 3-4 shows a short description of the different instructions available on the Coolrisc816. The notation cc in the
conditional jump instruction refers to the condition description as given in Table 3-6. The notation reg, reg1, reg2,
reg3 refers to one of the CPU internal registers of Table 3-1. The notation eaddr and DM(eaddr) refer to one of the
extended address modes as defined in Table 3-5. The notation DM(xxx) refers to the data memory location with
address xxx.
Instruction
Modification
Operation
Jump addr[15:0]
-,-,-, -
PC := addr[15:0]
Jump ip
-,-,-, -
PC := ip
Jcc addr[15:0]
-,-,-, -
if cc is true then PC := addr[15:0]
Jcc ip
-,-,-, -
if cc is true then PC := ip
Call addr[15:0]
-,-,-, -
STn+1 := STn (n>1); ST1 := PC+1; PC := addr[15:0]
Call ip
-,-,-, -
STn+1 := STn (n>1); ST1 := PC+1; PC := ip
Calls addr[15:0]
-,-,-, -
ip := PC+1; PC := addr[15:0]
Calls ip
-,-,-, -
ip := PC+1; PC := ip
Ret
-,-,-, -
PC := ST1; STn := STn+1 (n>1)
Rets
-,-,-, -
PC := ip
Reti
-,-,-, -
PC := ST1; STn := STn+1 (n>1); GIE :=1
Push
-,-,-, -
PC := PC+1; STn+1 := STn (n>1); ST1 := ip
Pop
-,-,-, -
PC := PC+1; ip := ST1; STn := STn+1 (n>1)
Move reg,#data[7:0]
-,-, Z, a
a := data[7:0]; reg := data[7:0]
Move reg1, reg2
-,-, Z, a
a := reg2; reg1 := reg2
Move reg, eaddr
-,-, Z, a
a := DM(eaddr); reg := DM(eaddr)
Move eaddr, reg
-,-,-, -
DM(eaddr) := reg
Move addr[7:0],#data[7:0]
-,-,-, -
DM(addr[7:0]) := data[7:0]
Cmvd reg1, reg2
-,-, Z, a
a := reg2; if C=0 then reg1 := a;
Cmvd reg, eaddr
-,-, Z, a
a := DM(eaddr); if C=0 then reg := a
Cmvs reg1, reg2
-,-, Z, a
a := reg2; if C=1 then reg1 := a;
Cmvs reg, eaddr
-,-, Z, a
a := DM(eaddr); if C=1 then reg := a
Shl reg1, reg2
C, V, Z, a
a := reg2<<1; a[0] := 0; C := reg2[7]; reg1 := a
Shl reg
C, V, Z, a
a := reg<<1; a[0] := 0; C := reg[7]; reg := a
Shl reg, eaddr
C, V, Z, a
a := DM(eaddr)<<1; a[0] :=0; C := DM(eaddr)[7]; reg := a
Shlc reg1, reg2
C, V, Z, a
a := reg2<<1; a[0] := C; C := reg2[7]; reg1 := a
Shlc reg
C, V, Z, a
a := reg<<1; a[0] := C; C := reg[7]; reg := a
Shlc reg, eaddr
C, V, Z, a
a := DM(eaddr)<<1; a[0] := C; C := DM(eaddr)[7]; reg := a
Shr reg1, reg2
C, V, Z, a
a := reg2>>1; a[7] := 0; C := reg2[0]; reg1 :=a
Shr reg
C, V, Z, a
a := reg>>1; a[7] := 0; C := reg[0]; reg := a
Shr reg, eaddr
C, V, Z, a
a := DM(eaddr)>>1; a[7] := 0; C := DM(eaddr)[0]; reg := a
Shrc reg1, reg2
C, V, Z, a
a := reg2>>1; a[7] := C; C := reg2[0]; reg1 := a
Shrc reg
C, V, Z, a
a := reg>>1; a[7] := C; C := reg[0]; reg := a
Shrc reg, eaddr
C, V, Z, a
a := DM(eaddr)>>1; a[7] := C; C := DM(eaddr)[0]; reg := a
Shra reg1, reg2
C, V, Z, a
a := reg2>>1; a[7] := reg2[7]; C := reg2[0]; reg1 := a
Shra reg
C, V, Z, a
a := reg>>1; a[7] := reg[7]; C := reg[0]; reg := a
Shra reg, eaddr
C, V, Z, a
a := DM(eaddr)>>1; a[7] := DM(eaddr)[7]; C := DM(eaddr)[0]; reg := a
Cpl1 reg1, reg2
-,-, Z, a
a := NOT(reg2); reg1 := a
Cpl1 reg
-,-, Z, a
a := NOT(reg); reg := a
Cpl1 reg, eaddr
-,-, Z, a
a := NOT(DM(eaddr)); reg := a
Cpl2 reg1, reg2
C, V, Z, a
a := NOT(reg2)+1; if a=0 then C:=1 else C := 0; reg1 := a
Cpl2 reg
C, V, Z, a
a := NOT(reg)+1; if a=0 then C:=1 else C := 0; reg := a
Cpl2 reg, eaddr
C, V, Z, a
a := NOT(DM(eaddr))+1; if a=0 then C:=1 else C := 0; reg := a
Cpl2c reg1, reg2
C, V, Z, a
a := NOT(reg2)+C; if a=0 and C=1 then C:=1 else C := 0; reg1 := a
Cpl2c reg
C, V, Z, a
a := NOT(reg)+C; if a=0 and C=1 then C:=1 else C := 0; reg := a
Cpl2c reg, eaddr
C, V, Z, a
a := NOT(DM(eaddr))+C; if a=0 and C=1 then C:=1 else C := 0; reg := a
Inc reg1, reg2
C, V, Z, a
a := reg2+1; if a=0 then C := 1 else C := 0; reg1 := a
Inc reg
C, V, Z, a
a := reg+1; if a=0 then C := 1 else C := 0; reg := a
Inc reg, eaddr
C, V, Z, a
a := DM(eaadr)+1; if a=0 then C := 1 else C := 0; reg := a
Incc reg1, reg2
C, V, Z, a
a := reg2+C; if a=0 and C=1 then C := 1 else C := 0; reg1 := a
Incc reg
C, V, Z, a
a := reg+C; if a=0 and C=1 then C := 1 else C := 0; reg := a
Incc reg, eaddr
C, V, Z, a
a := DM(eaadr)+C; if a=0 and C=1 then C := 1 else C := 0; reg := a
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