參數(shù)資料
型號(hào)： XCV400E-7FG676C
廠商： Xilinx Inc
文件頁(yè)數(shù)： 33/233頁(yè)
文件大小： 0K
描述： IC FPGA 1.8V C-TEMP 676-FBGA
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標(biāo)準(zhǔn)包裝： 1
系列： Virtex®-E
LAB/CLB數(shù)： 2400
邏輯元件/單元數(shù)： 10800
RAM 位總計(jì)： 163840
輸入/輸出數(shù)： 404
門(mén)數(shù)： 569952
電源電壓： 1.71 V ~ 1.89 V
安裝類(lèi)型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 676-BGA
供應(yīng)商設(shè)備封裝： 676-FBGA（27x27）
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
Module 4 of 4
DS022-4 (v3.0) March 21, 2014
42
Production Product Specification
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
BG560 Differential Pin Pairs
Virtex-E devices have differential pin pairs that can also pro-
vide other functions when not used as a differential pair. A
√
in the AO column indicates that the pin pair can be used as
an asynchronous output for all devices provided in this
package. Pairs with a note number in the AO column are
device dependent. They can have asynchronous outputs if
the pin pair are in the same CLB row and column in the
device. Numbers in this column refer to footnotes that indi-
cate which devices have pin pairs than can be asynchro-
nous outputs. The Other Functions column indicates
alternative function(s) not available when the pair is used as
a differential pair or differential clock.
Table 15: BG560 Differential Pin Pair Summary
XCV400E, XCV600E, XCV1000E, XCV1600E, XCV2000E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
Global Differential Clock
0
4
AL17
AM17
NA
IO_DLL_L15P
1
5
AJ17
AM18
NA
IO_DLL_L15N
2
1
D17
E17
NA
IO_DLL_L21P
3
0
A17
C18
NA
IO_DLL_L21N
IO LVDS
Total Outputs: 183, Asynchronous Outputs: 87
00
D29
E28
8
VREF
10
A31
D28
√
-
20
C29
E27
√
VREF
30
D27
B30
3
-
40
B29
E26
√
-
50
C27
D26
√
VREF
60
A28
E25
9
VREF
70
C26
D25
7
-
80
B26
E24
7
VREF
90
D24
C25
2
-
10
0
A25
E23
√
VREF
11
0
B24
D23
√
-
12
0
C23
E22
8
-
13
0
D22
A23
√
-
14
0
B22
E21
√
VREF
15
0
C21
D21
3
-
16
0
E20
B21
√
-
17
0
C20
D20
√
VREF
18
0
E19
B20
9
-
19
0
C19
D19
7
-
20
0
D18
A19
7
VREF
21
1
E17
C18
NA
IO_LVDS_DLL
22
1
B17
C17
2
VREF
23
1
D16
B16
7
VREF
24
1
C16
E16
7
-
25
1
C15
A15
9
-
26
1
E15
D15
√
VREF
27
1
D14
C14
√
-
28
1
E14
A13
3
-
29
1
D13
C13
√
VREF
30
1
E13
C12
√
-
31
1
D12
A11
8
-
32
1
C11
B11
√
-
33
1
D11
B10
√
VREF
34
1
A9
C10
10
-
35
1
D10
C9
7
VREF
36
1
B8
A8
7
-
37
1
C8
E10
5
VREF
38
1
A6
B7
√
VREF
39
1
D8
C7
√
-
40
1
B5
A5
11
-
41
1
D7
C6
√
VREF
42
1
B4
A4
√
-
43
1
E7
C5
12
VREF
44
1
A2
D6
√
CS
45
2
D4
E4
√
DIN, D0
46
2
F5
B3
17
VREF
Table 15: BG560 Differential Pin Pair Summary
XCV400E, XCV600E, XCV1000E, XCV1600E, XCV2000E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
相關(guān)PDF資料
PDF描述
XCV400E-7BG560C IC FPGA 1.8V C-TEMP 560-MBGA
BQ4014YMB-85 IC NVSRAM 2MBIT 85NS 32DIP
BQ4014MB-85 IC NVSRAM 2MBIT 85NS 32DIP
XC5VLX50-2FF324C IC FPGA VIRTEX-5 50K 324FBGA
ABB55DHBD CONN EDGECARD 110PS R/A .050 SLD
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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XCV400E-7HQ240C 制造商:XILINX 制造商全稱(chēng):XILINX 功能描述:Virtex-E 1.8 V Field Programmable Gate Arrays
XCV400E-7HQ240I 制造商:XILINX 制造商全稱(chēng):XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays
XCV400E-7PQ240C 功能描述:IC FPGA 1.8V C-TEMP 240-PQFP RoHS:否 類(lèi)別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列） 系列:Virtex®-E 產(chǎn)品變化通告:Step Intro and Pkg Change 11/March/2008 標(biāo)準(zhǔn)包裝:1 系列:Virtex®-5 SXT LAB/CLB數(shù):4080 邏輯元件/單元數(shù):52224 RAM 位總計(jì):4866048 輸入/輸出數(shù):480 門(mén)數(shù):- 電源電壓:0.95 V ~ 1.05 V 安裝類(lèi)型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:1136-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5
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