參數(shù)資料
型號(hào)： XCV300E-7BG352I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 139/233頁(yè)
文件大小： 0K
描述： IC FPGA 1.8V I-TEMP 352-MBGA
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標(biāo)準(zhǔn)包裝： 1
系列： Virtex®-E
LAB/CLB數(shù)： 1536
邏輯元件/單元數(shù)： 6912
RAM 位總計(jì)： 131072
輸入/輸出數(shù)： 260
門(mén)數(shù)： 411955
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 352-LBGA，金屬
供應(yīng)商設(shè)備封裝： 352-MBGA（35x35）
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
DS022-4 (v3.0) March 21, 2014
Module 4 of 4
Production Product Specification
137
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
FG1156 Differential Pin Pairs
Virtex-E devices have differential pin pairs that can also pro-
vide other functions when not used as a differential pair. The
AO column in Table 29 indicates which devices in this pack-
age can use the pin pair as an asynchronous output. The
“Other Functions” column indicates alternative function(s)
that are not available when the pair is used as a differential
pair or differential clock
.
Table 29: FG1156 Differential Pin Pair Summary:
XCV1000E, XCV1600E, XCV2000E, XCV2600E, XCV3200E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
GCLK LVDS
3
0
E17
C17
NA
IO_DLL_L 42N
2
1
D17
J18
NA
IO_DLL_L 42P
1
5
AL19
AL17
NA
IO_DLL_L 215N
0
4
AH18
AM18
NA
IO_DLL_L 215P
IO LVDS
Total Pairs: 344, Asynchronous Output Pairs: 134
00
H9
F7
3200 1600
1000
-
1
0
J10
C5
3200 2000
1000
-
20
D6
E6
3200 2000
1000
VREF
30
G8
A4
3200 2600
1000
-
4
0
J11
C6
3200 2600
2000 1600
1000
-
50
F8
G9
3200 2600
2000 1600
1000
VREF
6
0
H10
A5
2000 1600
-
7
0
B5
D7
3200 1000
-
8
0
E8
K12
3200 1000
-
9
0
F9
B6
3200 2600
-
10
0
C7
G10
3200 2600
2000 1600
1000
-
11
0
B7
D8
3200 2600
2000 1600
1000
VREF
12
0
C8
H11
3200 1600
-
13
0
B8
E9
3200 2000
1000
-
14
0
G11
K13
3200 2000
1000
VREF
15
0
F10
A8
3200 2600
-
160H12
C9
3200 2600
2000 1600
1000
-
17
0
A9
D10
3200 2600
2000 1600
1000
VREF
18
0
A10
F11
2600 1600
1000
-
190C10
K14
2600 1600
1000
-
20
0
G12
H13
3200 2600
2000 1600
1000
VREF
21
0
B11
A11
3200 2600
2000 1600
1000
-
220D11
E12
3200 1600
1000
-
230C12
G13
3200 2000
1000
-
24
0
A12
K15
3200 2000
1000
-
250H14
B12
3200 2600
1000
-
26
0
F13
D12
3200 2600
2000 1600
1000
-
27
0
B13
A13
3200 2600
2000 1600
1000
VREF
28
0
G14
J15
2000 1600
-
29
0
F14
C13
3200 2600
1000
-
300D13
H15
3200 2600
1000
-
31
0
K16
A14
3200
-
Table 29: FG1156 Differential Pin Pair Summary:
XCV1000E, XCV1600E, XCV2000E, XCV2600E, XCV3200E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
相關(guān)PDF資料
PDF描述
HMC43DRAH CONN EDGECARD 86POS R/A .100 SLD
XCV400E-7PQ240C IC FPGA 1.8V C-TEMP 240-PQFP
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XCV400E-6PQ240I IC FPGA 1.8V I-TEMP 240-PQFP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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