參數資料
型號： XCV1000E-7FG1156C
廠商： Xilinx Inc
文件頁數： 180/233頁
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描述： IC FPGA 1.8V C-TEMP 1156-FBGA
產品變化通告： FPGA Family Discontinuation 18/Apr/2011
標準包裝： 1
系列： Virtex®-E
LAB/CLB數： 6144
邏輯元件/單元數： 27648
RAM 位總計： 393216
輸入/輸出數： 660
門數： 1569178
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1156-BBGA
供應商設備封裝： 1156-FBGA（35x35）
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
Module 2 of 4
DS022-2 (v3.0) March 21, 2014
44
Production Product Specification
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
SSTL2_II
A sample circuit illustrating a valid termination technique for
SSTL2_II appears in Figure 52. DC voltage specifications
appear in Table 31.
CTT
A sample circuit illustrating a valid termination technique for
CTT appear in Figure 53. DC voltage specifications appear
PCI33_3 & PCI66_3
PCI33_3 or PCI66_3 require no termination. DC voltage
specifications appear in Table 33.
Figure 52: Terminated SSTL2 Class II
Table 31: SSTL2_II Voltage Specifications
Parameter
Min
Typ
Max
VCCO
2.3
2.5
2.7
VREF = 0.5 × VCCO
1.15
1.25
1.35
VTT = VREF + N(1)
1.11
1.25
1.39
VIH = VREF + 0.18
1.33
1.43
3.0(2)
VIL = VREF – 0.18
0.3(3)
1.07
1.17
VOH = VREF + 0.8
1.95
-
VOL = VREF – 0.8
-
0.55
IOH at VOH (mA)
15.2
-
IOLat VOL (mA)
15.2
-
Notes:
1.
N must be greater than or equal to -0.04 and less than or
equal to 0.04.
2.
VIH maximum is VCCO + 0.3.
3.
VIL minimum does not conform to the formula.
Figure 53: Terminated CTT
50
Ω
Z = 50
SSTL2 Class II
x133_16_111699
25
Ω
50
Ω
VREF = 1.25V
VTT= 1.25V
VCCO = 2.5V
VREF= 1.5V
VTT = 1.5V
50
Ω
VCCO = 3.3V
Z = 50
CTT
x133_17_111699
Table 32: CTT Voltage Specifications
Parameter
Min
Typ
Max
VCCO
2.05(1)
3.3
3.6
VREF
1.35
1.5
1.65
VTT
1.35
1.5
1.65
VIH = VREF + 0.2
1.55
1.7
-
VIL = VREF – 0.2
-
1.3
1.45
VOH = VREF + 0.4
1.75
1.9
-
VOL= VREF – 0.4
-
1.1
1.25
IOH at VOH (mA)
8-
-
IOLat VOL (mA)
8
-
Notes:
1.
Timing delays are calculated based on VCCO min of 3.0V.
Table 33: PCI33_3 and PCI66_3 Voltage Specifications
Parameter
Min
Typ
Max
VCCO
3.0
3.3
3.6
VREF
--
-
VTT
--
-
VIH = 0.5 × VCCO
1.5
1.65
VCCO +0.5
VIL = 0.3 × VCCO
0.5
0.99
1.08
VOH = 0.9 × VCCO
2.7
-
VOL= 0.1 × VCCO
-
0.36
IOH at VOH (mA)
Note 1
-
IOLat VOL (mA)
Note 1
-
Notes:
1.
Tested according to the relevant specification.
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PDF描述
XCV1000E-6FG1156I IC FPGA 1.8V I-TEMP 1156-FBGA
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