參數(shù)資料
型號: XC5VLX110-2FF676I
廠商: Xilinx Inc
文件頁數(shù): 52/91頁
文件大小: 0K
描述: IC FPGA VIRTEX-5 110K 676FBGA
標準包裝: 1
系列: Virtex®-5 LX
LAB/CLB數(shù): 8640
邏輯元件/單元數(shù): 110592
RAM 位總計: 4718592
輸入/輸出數(shù): 440
電源電壓: 0.95 V ~ 1.05 V
安裝類型: 表面貼裝
工作溫度: -40°C ~ 100°C
封裝/外殼: 676-BBGA,F(xiàn)CBGA
供應商設備封裝: 676-FCBGA(27x27)
配用: 568-5088-ND - BOARD DEMO DAC1408D750
HW-V5-ML523-UNI-G-ND - EVALUATION PLATFORM VIRTEX-5
HW-AFX-FF676-500-G-ND - BOARD DEV VIRTEX 5 FF676
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
56
Table 75: PLL in PMCD Mode Switching Characteristics
Symbol
Description
Speed Grade
Units
-3
-2
-1
TPLLCCK_REL/TPLLCKC_REL
REL Setup and Hold for all Outputs
0.00
0.60
0.00
0.60
0.00
0.60
ns
TPLLCCKO
Maximum Clock Propagation Delay
4.6
5.2
ns
CLKIN_FREQ_MAX
Maximum Input Frequency
710
645
MHz
CLKIN_FREQ_MIN
Minimum Input Frequency
1
MHz
CLKIN_DUTY_CYCLE
Allowable Input Duty Cycle: 1—49 MHz
25/75
%
Allowable Input Duty Cycle: 50—199 MHz
30/70
%
Allowable Input Duty Cycle: 200—399 MHz
35/65
%
Allowable Input Duty Cycle: 400—499 MHz
40/60
%
Allowable Input Duty Cycle: >500 MHz
45/55
%
RES_REL_PULSE_MIN
Minimum Pulse Width for RST and REL
5
ns
相關PDF資料
PDF描述
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相關代理商/技術參數(shù)
參數(shù)描述
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XC5VLX110-2FFG1760C 功能描述:IC FPGA VIRTEX-5 110K 1760FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA(現(xiàn)場可編程門陣列) 系列:Virtex®-5 LX 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計:3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應商設備封裝:120-CPGA(34.55x34.55)
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