參數(shù)資料
型號： XC4VFX100-11FFG1152I
廠商： XILINX INC
元件分類： FPGA
英文描述： FPGA, 10544 CLBS, 1181 MHz, PBGA1152
封裝： LEAD FREE, FBGA-1152
文件頁數(shù)： 40/58頁
文件大?。?/td> 1863K
代理商： XC4VFX100-11FFG1152I
Virtex-4 FPGA Data Sheet: DC and Switching Characteristics
DS302 (v3.7) September 9, 2009
Product Specification
45
Table 55: Global Clock Input to Output Delay for LVCMOS25 Standard, 12 mA, Fast Slew Rate, without DCM
Symbol
Description
Device
Speed Grade
Units
-12
-11
-10
LVCMOS25 Global Clock Input to Output Delay using Output Flip-Flop, 12 mA, Fast Slew Rate, without DCM.
TICKOF
Global Clock and OFF without DCM
XC4VLX15
6.42
7.22
8.14
ns
XC4VLX25
6.50
7.32
8.25
ns
XC4VLX40
6.70
7.54
8.50
ns
XC4VLX60
6.86
7.72
8.70
ns
XC4VLX80
6.98
7.85
8.85
ns
XC4VLX100
7.23
8.15
9.18
ns
XC4VLX160
7.46
8.40
9.46
ns
XC4VLX200
N/A
8.79
9.88
ns
XC4VSX25
6.69
7.52
8.47
ns
XC4VSX35
6.75
7.59
8.56
ns
XC4VSX55
7.10
7.99
9.00
ns
XC4VFX12
6.41
7.21
8.13
ns
XC4VFX20
6.60
7.42
8.37
ns
XC4VFX40
6.97
7.84
8.83
ns
XC4VFX60
6.98
7.86
8.85
ns
XC4VFX100
7.46
8.40
9.45
ns
XC4VFX140
N/A
8.80
9.90
ns
Notes:
1.
Listed above are representative values where one global clock input drives one vertical clock line in each accessible column, and where all
accessible IOB and CLB flip-flops are clocked by the global clock net.
相關(guān)PDF資料
PDF描述
XC4VFX100-11FFG1517I FPGA, 10544 CLBS, 1181 MHz, PBGA1517
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XC4VFX100-12FFG1517C FPGA, 10544 CLBS, 1181 MHz, PBGA1517
XC5206-3PCG84I FPGA, 196 CLBS, 6000 GATES, 83 MHz, PQCC84
XC5206-3PQG100I FPGA, 196 CLBS, 6000 GATES, 83 MHz, PQFP100
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參數(shù)描述
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XC4VFX100-12FF1152C 制造商:Xilinx 功能描述:
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