參數(shù)資料
型號： XC4008E-1PC84C
廠商： Xilinx Inc
文件頁數(shù)： 61/68頁
文件大小： 0K
描述： IC FPGA C-TEMP 5V 1SPD 84-PLCC
產(chǎn)品變化通告： XC4000(XL,XLA,E) Discontinuation 15/Nov/2004
標(biāo)準(zhǔn)包裝： 15
系列： XC4000E/X
LAB/CLB數(shù)： 324
邏輯元件/單元數(shù)： 770
RAM 位總計： 10368
輸入/輸出數(shù)： 61
門數(shù)： 8000
電源電壓： 4.75 V ~ 5.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 84-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 84-PLCC
R
XC4000E and XC4000X Series Field Programmable Gate Arrays
6-68
May 14, 1999 (Version 1.6)
Conguration Switching Characteristics
Master Modes (XC4000E/EX)
Master Modes (XC4000XL)
Slave and Peripheral Modes (All)
Description
Symbol
Min
Max
Units
Power-On Reset
M0 = High
TPOR
10
40
ms
M0 = Low
TPOR
40
130
ms
Program Latency
TPI
30
200
s per
CLB column
CCLK (output) Delay
TICCK
40
250
s
CCLK (output) Period, slow
TCCLK
640
2000
ns
CCLK (output) Period, fast
TCCLK
80
250
ns
Description
Symbol
Min
Max
Units
Power-On Reset
M0 = High
TPOR
10
40
ms
M0 = Low
TPOR
40
130
ms
Program Latency
TPI
30
200
s per
CLB column
CCLK (output) Delay
TICCK
40
250
s
CCLK (output) Period, slow
TCCLK
540
1600
ns
CCLK (output) Period, fast
TCCLK
67
200
ns
Description
Symbol
Min
Max
Units
Power-On Reset
TPOR
10
33
ms
Program Latency
TPI
30
200
s per
CLB column
CCLK (input) Delay (required)
TICCK
4
s
CCLK (input) Period (required)
TCCLK
100
ns
VALID
PROGRAM
INIT
Vcc
PI
T
POR
T
ICCK
T
CCLK
T
CCLK OUTPUT or INPUT
M0, M1, M2
DONE RESPONSE
<300 ns
>300 ns
RE-PROGRAM
X1532
(Required)
I/O
Product Obsolete or Under Obsolescence
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PDF描述
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