參數(shù)資料
型號： XC3S400-5FGG456C
廠商： Xilinx Inc
文件頁數(shù)： 246/272頁
文件大?。?/td> 0K
描述： SPARTAN-3A FPGA 400K 456-FBGA
產(chǎn)品培訓(xùn)模塊： Extended Spartan 3A FPGA Family
標(biāo)準(zhǔn)包裝： 60
系列： Spartan®-3
LAB/CLB數(shù)： 896
邏輯元件/單元數(shù)： 8064
RAM 位總計(jì)： 294912
輸入/輸出數(shù)： 264
門數(shù)： 400000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 456-BBGA
供應(yīng)商設(shè)備封裝： 456-FBGA
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Spartan-3 FPGA Family: DC and Switching Characteristics
DS099 (v3.1) June 27, 2013
Product Specification
75
Table 45: Timing for the IOB Output Path
Symbol
Description
Conditions
Device
Speed Grade
Units
-5
-4
Max(3)
Clock-to-Output Times
TIOCKP
When reading from the Output
Flip-Flop (OFF), the time from the
active transition at the OTCLK input to
data appearing at the Output pin
LVCMOS25(2), 12 mA output
drive, Fast slew rate
XC3S200
XC3S400
1.28
1.47
ns
XC3S50
XC3S1000
XC3S1500
XC3S2000
XC3S4000
XC3S5000
1.95
2.24
ns
Propagation Times
TIOOP
The time it takes for data to travel from
the IOB’s O input to the Output pin
LVCMOS25(2), 12 mA output
drive, Fast slew rate
XC3S200
XC3S400
1.28
1.46
ns
XC3S50
XC3S1000
XC3S1500
XC3S2000
XC3S4000
XC3S5000
1.94
2.23
ns
TIOOLP
The time it takes for data to travel from
the O input through the OFF latch to
the Output pin
XC3S200
XC3S400
1.28
1.47
ns
XC3S50
XC3S1000
XC3S1500
XC3S2000
XC3S4000
XC3S5000
1.95
2.24
ns
Set/Reset Times
TIOSRP
Time from asserting the OFF’s SR
input to setting/resetting data at the
Output pin
LVCMOS25(2), 12 mA output
drive, Fast slew rate
XC3S200
XC3S400
2.10
2.41
ns
XC3S50
XC3S1000
XC3S1500
XC3S2000
XC3S4000
XC3S5000
2.77
3.18
ns
TIOGSRQ
Time from asserting the Global Set
Reset (GSR) net to setting/resetting
data at the Output pin
All
8.07
9.28
ns
Notes:
1.
The numbers in this table are tested using the methodology presented in Table 48 and are based on the operating conditions set forth in
2.
This time requires adjustment whenever a signal standard other than LVCMOS25 with 12 mA drive and Fast slew rate is assigned to the data
Output. When this is true, add the appropriate Output adjustment from Table 47.
3.
For minimums, use the values reported by the Xilinx timing analyzer.
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PDF描述
XC3S1000-4FT256I IC FPGA SPARTAN 3 256FTBGA
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XC2V40-5FGG256C IC FPGA VIRTEX-II 40K 256-FBGA
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XC3S400-5FT256I 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA Family : Complete Data Sheet
XC3S400-5FTG256C 功能描述:SPARTAN-3A FPGA 400K 256-FTBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Spartan®-3 標(biāo)準(zhǔn)包裝:40 系列:Spartan® 6 LX LAB/CLB數(shù):3411 邏輯元件/單元數(shù):43661 RAM 位總計(jì):2138112 輸入/輸出數(shù):358 門數(shù):- 電源電壓:1.14 V ~ 1.26 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:676-BGA 供應(yīng)商設(shè)備封裝:676-FBGA（27x27）
XC3S400-5PQ208C 制造商:Xilinx 功能描述:FPGA SPARTAN-3 400K GATES 8064 CELLS 725MHZ 1.2V 208PQFP - Trays
XC3S400-5PQ208I 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA Family: Complete Data Sheet
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