參數(shù)資料
型號： XA3S1400A-4FGG484Q
廠商： Xilinx Inc
文件頁數(shù)： 44/57頁
文件大小： 0K
描述： IC FPGA SPARTAN3A 1400K 484-FBGA
標準包裝： 1
系列： Spartan®-3A XA
LAB/CLB數(shù)： 2816
邏輯元件/單元數(shù)： 25344
RAM 位總計： 589824
輸入/輸出數(shù)： 375
門數(shù)： 1400000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 125°C
封裝/外殼： 484-BBGA
供應商設備封裝： 484-FBGA
XA Spartan-3A Automotive FPGA Family Data Sheet
DS681 (v2.0) April 22, 2011
Product Specification
49
Table 46: Master Mode CCLK Output Frequency by ConfigRate Option Setting
Symbol
Description
ConfigRate
Setting
Temperature
Range
Minimum
Maximum
Units
FCCLK1
Equivalent CCLK clock frequency
by ConfigRate setting
1
(power-on value)
I-Grade/
Q-Grade
0.40
0.95
MHz
FCCLK3
3
I-Grade/
Q-Grade
1.20
2.85
MHz
FCCLK6
6
I-Grade/
Q-Grade
2.40
5.74
MHz
FCCLK7
7
I-Grade/
Q-Grade
2.80
6.74
MHz
FCCLK8
8
I-Grade/
Q-Grade
3.20
7.58
MHz
FCCLK10
10
I-Grade/
Q-Grade
4.00
9.65
MHz
FCCLK12
12
I-Grade/
Q-Grade
4.80
11.48
MHz
FCCLK13
13
I-Grade/
Q-Grade
5.20
12.49
MHz
FCCLK17
17
I-Grade/
Q-Grade
6.80
16.33
MHz
FCCLK22
22
I-Grade/
Q-Grade
8.80
21.23
MHz
FCCLK25
25
I-Grade/
Q-Grade
10.00
23.59
MHz
FCCLK27
27
I-Grade/
Q-Grade
10.80
28.31
MHz
FCCLK33
33
I-Grade/
Q-Grade
13.20
32.67
MHz
FCCLK44
44
I-Grade/
Q-Grade
17.60
42.47
MHz
FCCLK50
50
I-Grade/
Q-Grade
20.00
53.08
MHz
FCCLK100
100
I-Grade/
Q-Grade
40.00
106.16
MHz
Table 47: Master Mode CCLK Output Minimum Low and High Time
Symbol
Description
ConfigRate Setting
Units
1
3
6
7
8
10
12
13
17
22
25
27
33
44
50
100
TMCCL,
TMCCH
Master Mode
CCLK
Minimum
Low and
High Time
I-Grade/
Q-Grade
474 158 78.4 66.8 59.3 46.6 39.2 36.0 27.6 21.2 19.1 15.9 13.8 10.6 8.5
4.2
ns
Table 48: Slave Mode CCLK Input Low and High Time
Symbol
Description
Min
Max
Units
TSCCL,
TSCCH
CCLK Low and High time
5
ns
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PDF描述
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