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參數(shù)資料
| 型號： | X98017L128-3.3-Z |
| 廠商： | Intersil |
| 文件頁數(shù)： | 12/29頁 |
| 文件大小： | 0K |
| 描述： | IC VIDEO DIGITIZER TRPL 128MQFP |
| 標(biāo)準(zhǔn)包裝： | 66 |
| 類型： | 視頻數(shù)字轉(zhuǎn)換器，3 通道 AFE |
| 應(yīng)用： | LCD 電視機(jī)/監(jiān)控器 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 128-MQFP（14x20） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 1247 (CN2011-ZH PDF) |
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2
FN8218.3
March 8, 2006
Block Diagram
Ordering Information
PART NUMBER
PART MARKING
MAXIMUM PIXEL
RATE
TEMP RANGE
(°C)
PACKAGE
X98017L128-3.3
X98017L-3.3
170MHz
0 to 70
128 MQFP
X98017L128-3.3-Z (See Note)
X98017L-3.3Z
170MHz
0 to 70
128 MQFP (Pb-free)
NOTE: Intersil Pb-free plus anneal products employ special Pb-free material sets; molding compounds/die attach materials and 100% matte tin plate
termination finish, which are RoHS compliant and compatible with both SnPb and Pb-free soldering operations. Intersil Pb-free products are MSL
classified at Pb-free peak reflow temperatures that meet or exceed the Pb-free requirements of IPC/JEDEC J STD-020.
G
IN1
RGB
GND1
G
IN2
RGB
GND2
V
IN+
V
IN-
PGA
8 bit ADC
+
V
CLAMP
R
IN1
R
IN2
V
IN+
V
IN-
PGA
8 bit ADC
+
V
CLAMP
B
IN1
B
IN2
V
IN+
V
IN-
PGA
8 bit ADC
+
V
CLAMP
Offset
DAC
Offset
DAC
Offset
DAC
ABLC
8
10
8
10
8
10
8
B
S[7:0]
8
B
P[7:0]
8
G
S[7:0]
8
G
P[7:0]
8
R
S[7:0]
8
R
P[7:0]
SOG
IN1
SOG
IN2
HSYNC
IN1
HSYNC
IN2
VSYNC
IN1
VSYNC
IN2
CLOCKINV
XTAL
IN
XTAL
OUT
SCL
SDA
SADDR
Sync
Processing
Digital PLL
AFE Configuration
and Control
DATACLK
HS
OUT
VS
OUT
Serial
Interface
Outp
ut
D
ata
Form
att
er
HSYNC
OUT
VSYNC
OUT
XTALCLK
OUT
X98017
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| X98027L128-3.3-Z | IC TRPL VID DIGITIZER 128MQFP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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