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參數(shù)資料
| 型號： | X9428YV14IZ-2.7T1 |
| 廠商： | Intersil |
| 文件頁數(shù)： | 8/21頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DGTL POT 2K 1CH 14TSSOP |
| 標準包裝： | 2,500 |
| 系列： | XDCP™ |
| 接片： | 64 |
| 電阻（歐姆）： | 2k |
| 電路數(shù)： | 1 |
| 溫度系數(shù)： | 標準值 ±300 ppm/°C |
| 存儲器類型： | 非易失 |
| 接口： | 串行 |
| 電源電壓： | 2.7 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 14-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 14-TSSOP |
| 包裝： | 帶卷 (TR) |
16
FN8197.1
April 26, 2006
HIGH-VOLTAGE WRITE CYCLE TIMING
XDCP TIMING
Note:
(8) A device must internally provide a hold time of at least 300ns for the SDA signal in order to bridge the undefined region of the falling
edge of SCL.
TIMING DIAGRAMS
START and STOP Timing
Input Timing
Output Timing
Symbol
Parameter
Typ.
Max.
Unit
tWR
High-voltage write cycle time (store instructions)
5
10
ms
Symbol
Parameter
Min.
Max.
Unit
tWRPO
Wiper response time after the third (last) power supply is stable
10
s
tWRL
Wiper response time after instruction issued (all load instructions)
10
s
tWRID
Wiper response time from an active SCL/SCK edge (increment/decrement instruction)
10
s
tSU:STA
tHD:STA
tSU:STO
SCL
SDA
tR
(START)
(STOP)
tF
tR
tF
SCL
SDA
tHIGH
tLOW
tCYC
tHD:DAT
tSU:DAT
tBUF
SCL
SDA
tDH
tAA
X9428
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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