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參數(shù)資料
| 型號： | X9259TS24Z-2.7 |
| 廠商： | Intersil |
| 文件頁數(shù)： | 7/21頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC XDCP QUAD 256TAP 100K 24-SOIC |
| 標準包裝： | 30 |
| 系列： | XDCP™ |
| 接片： | 256 |
| 電阻（歐姆）： | 100k |
| 電路數(shù)： | 4 |
| 溫度系數(shù)： | 標準值 ±300 ppm/°C |
| 存儲器類型： | 非易失 |
| 接口： | I²C（設備位址） |
| 電源電壓： | 2.7 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-SOIC（0.295"，7.50mm 寬） |
| 供應商設備封裝： | 24-SOIC |
| 包裝： | 管件 |
15
FN8169.5
April 13, 2007
Equivalent A.C. Load Circuit
5V
1533
Ω
100pF
SDA pin
RH
10pF
CL
RW
RTOTAL
CW
25pF
10pF
RL
SPICE Macromodel
AC Timing
SYMBOL
PARAMETER
MIN
MAX
UNITS
fSCL
Clock Frequency
400
kHz
tCYC
Clock Cycle Time
2500
ns
tHIGH
Clock High Time
600
ns
tLOW
Clock Low Time
1300
ns
tSU:STA
Start Setup Time
600
ns
tHD:STA
Start Hold Time
600
ns
tSU:STO
Stop Setup Time
600
ns
tSU:DAT
SDA Data Input Setup Time
100
ns
tHD:DAT
SDA Data Input Hold Time
30
ns
tR
SCL and SDA Rise Time
300
ns
tF
SCL and SDA Fall Time
300
ns
tAA
SCL Low to SDA Data Output Valid Time
0.9
μs
tDH
SDA Data Output Hold Time
0
ns
TI
Noise Suppression Time Constant at SCL and SDA inputs
50
ns
tBUF
Bus Free Time (Prior to Any Transmission)
1200
ns
tSU:WPA
A0, A1 Setup Time
0
ns
tHD:WPA
A0, A1 Hold Time
0
ns
High-Voltage Write Cycle Timing
SYMBOL
PARAMETER
TYP
MAX
UNITS
tWR
High-voltage write cycle time (store instructions)
5
10
ms
XDCP Timing
SYMBOL
PARAMETER
MIN
MAX
UNITS
tWRPO
Wiper response time after the third (last) power supply is stable
5
10
μs
tWRL
Wiper response time after instruction issued (all load instructions)
5
10
μs
X9259
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