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參數(shù)資料
| 型號(hào)： | W83L951DG |
| 廠商： | Nuvoton Technology Corporation of America |
| 文件頁數(shù)： | 65/112頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC EMBEDDED CNTRLR 128-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | W83 |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 24MHz |
| 連通性： | 主機(jī)接口，PS/2，SMBus，UART/USART |
| 外圍設(shè)備： | PWM，WDT |
| 輸入/輸出數(shù)： | 104 |
| 程序存儲(chǔ)器容量： | 64KB（64K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b; D/A 2x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 128-LQFP |
| 包裝： | 托盤 |
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W83L951DG/W83L951FG
- 52 -
Bit 5: Master Almost Full Event
Indicate that Master generate Almost Full Event. It occurs only up to Almost Full level.
Bit 4: Master Almost Empty Event
Indicate that Master generate Almost Empty Event. It occurs only down to Almost Empty level.
Bit 3: Master FIFO Data Write Error Event
Indicate that Microprocessor writes to Master FIFO, Master FIFO is full or Read Mode.
Bit 2: NACK Received Event
Indicate that Master receives NACK. After generating Stop Phase, Master will be back to initial state
and clear FIFO.
Note: Wait for the response of Clear Finished Event in Master Status Register to start next
transfer.
Bit 1: Bus Arbitration Failed Event
Indicate that bus arbitration failed. Master will be back to initial state and clear FIFO.
Bit 0: FIFO Clear Finished Event
Indicate that Master finishes the request to clear FIFO.
Note: When Micro Processors has not proposed Master FIFO Clear Request but produces, it
indicates the remote device to drive SCL low to generate timeout.
6.4.1.8
Master FIFO Status Register (SM1/2MFIFOSTS) (Default Value: 0100_0000)
Bit 7: Full Flag
Bit 6: Empty Flag
Bit 5~4: Reserved
Bit 3~0: FIFO Data Length
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