Publication Release Date: January 2009 - 13 - Revision A11 SYMBOL DESCRIPTION MIN TYP MAX UNIT 1/T
參數資料
型號： W681511SG TR
廠商： Nuvoton Technology Corporation of America
文件頁數： 5/32頁
文件大?。?/td> 0K
描述： IC VOICEBAND CODEC 5V 1CH 20SOP
其它有關文件： CODEC Block Diagram
標準包裝： 1,000
類型： PCM
數據接口： PCM 音頻接口
分辨率（位）： 8 b
ADC / DAC 數量： 1 / 1
三角積分調變： 無
電壓 - 電源，模擬： 4.5 V ~ 5.5 V
電壓 - 電源，數字： 4.5 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
供應商設備封裝： 20-SOP
包裝： 帶卷 (TR)
配用： W681513DK-ND - KIT DEVELOPMENT FOR W681513
W681512DK-ND - KIT DEVELOPMENT FOR W681512
W681511DK-ND - KIT DEVELOPMENT FOR W681511
W681512ES-ND - EVALUATION SYSTEM FOR W681512
其它名稱： W681511SG T&R
W681511SG T&R-ND
W681511
Publication Release Date: January 2009
- 13 -
Revision A11
SYMBOL
DESCRIPTION
MIN
TYP
MAX
UNIT
1/TFS
FST, FSR Frequency
---
8
---
kHz
TFSL
FST / FSR Minimum Low Width
1
TBCK
sec
1/TBCK
BCLKT, BCLKR Frequency
64
---
4096
kHz
TBCKH
BCLKT, BCLKR High Pulse Width
50
---
ns
TBCKL
BCLKT, BCLKR Low Pulse Width
50
---
ns
TFTRH
BCLKT 0 Falling Edge to FST Rising
Edge Hold Time
20
---
ns
TFTRS
FST Rising Edge to BCLKT 1 Falling
edge Setup Time
80
---
ns
TFTFH
BCLKT 2 Falling Edge to FST Falling
Edge Hold Time
50
---
ns
TFDTD
FST Rising Edge to Valid PCMT Delay
Time
---
60
ns
TBDTD
BCLKT Rising Edge to Valid PCMT
Delay Time
---
60
ns
THID
Delay Time from the Later of FST
Falling Edge, or
BCLKT 8 Falling Edge to PCMT Output
High Impedance
10
---
60
ns
TFRRH
BCLKR 0 Falling Edge to FSR Rising
Edge Hold Time
20
---
ns
TFRRS
FSR Rising Edge to BCLKR 1 Falling
edge Setup Time
80
---
ns
TFRFH
BCLKR 2 Falling Edge to FSR Falling
Edge Hold Time
50
---
ns
TDRS
Valid PCMR to BCLKR Falling Edge
Setup Time
0
---
ns
TDRH
PCMR Hold Time from BCLKR Falling
Edge
50
---
ns
Table 8.1 Long Frame Sync PCM Timing Parameters
1 T
FSL must be at least ≥ TBCK
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PDF描述
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