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參數(shù)資料
| 型號： | UPSD3433 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic |
| 中文描述： | Turbo Plus系列高速渦輪8032 USB和可編程邏輯控制器 |
| 文件頁數(shù)： | 107/264頁 |
| 文件大?。?/td> | 4320K |
| 代理商： | UPSD3433 |
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107/264
uPSD34xx - I
2
C INTERFACE
I
2
C Data Shift Register (S1DAT)
The S1ADR register (Table
57
) holds a byte of se-
rial data to be transmitted or it holds a serial byte
that has just been received. The MCU may access
S1DAT while the SIOE is not in the process of
shifting a byte (the INTR flag indicates shifting is
complete).
While transmitting, bytes are shifted out MSB first,
and when receiving, bytes are shifted in MSB first,
through the Acknowledge Bit register as shown in
Figure 43., page 102
.
Bus Wait Condition.
After the SIOE finishes re-
ceiving a byte in Receive mode, or transmitting a
byte in Transmit mode, the INTR flag (in S1STA)
is set and automatically a wait condition is im-
posed on the I
2
C bus (SCL held low by SIOE). In
Transmit mode, this wait condition is released as
soon as the MCU writes any byte to S1DAT. In Re-
ceive mode, the wait condition is released as soon
as the MCU reads the S1DAT register.
This method allows the user to handle transmit
and receive operations within an interrupt service
routine. The SIOE will automatically stall the I
2
C
bus at the appropriate time, giving the MCU time
to get the next byte ready to transmit or time to
read the byte that was just received.
Table 57. S1DAT: I
2
C Data Shift register (SFR DEh, reset value 00h)
I
2
C Address Register (S1ADR)
The S1ADR register (Table
58
) holds the 7-bit de-
vice address used when the SIOE is operating as
a Slave. When the SIOE receives an address from
a Master, it will compare this address to the con-
tents
of
S1ADR,
as
43., page 102
.
shown
in
Figure
If the 7 bits match, the INTR Interrupt flag (in
S1STA) is set, and the ADDR Bit (in S1CON) is
set. The SIOE cannot modify the contents S1ADR,
and S1ADR is not used during Master mode.
Table 58. S1ADR: I
2
C Address register (SFR DFh, reset value 00h)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
S1DAT[7:0]
Details
Bit
Symbol
R/W
Function
7:0
S1DAT[7:0]
R/W
Holds the data byte to be transmitted in Transmit mode, or it holds the
data byte received in Receiver mode.
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
SLA6
SLA5
SLA4
SLA3
SLA2
SLA1
SLA0
–
Details
Bit
Symbol
R/W
Function
7:1
SLA[6:0]
R/W
Stores desired 7-bit device address, used when SIOE is in Slave mode.
0
–
–
Not used
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| UPSD3433EB40T6 | 功能描述:8位微控制器 -MCU Turbo 8032 MCU w/USB & Programmable Logic RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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