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參數(shù)資料
| 型號： | UPSD3432 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic |
| 中文描述： | Turbo Plus系列高速渦輪8032 USB和可編程邏輯控制器 |
| 文件頁數(shù)： | 130/264頁 |
| 文件大?。?/td> | 4320K |
| 代理商： | UPSD3432 |
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uPSD34xx - USB INTERFACE
130/264
FIFO Pairing.
The FIFOs on endpoints 1 through
4 may be used independently as shown in
Figure
54.
as FIFOs with no Pairing or they may be selec-
tively paired to provide double buffering (see
Fig-
ure 55., page 131
). Double buffering provides an
efficient way to optimize data transfer rates with
bulk transfers. Double buffering allows the CPU to
process a data packet for an Endpoint while the
SIE is receiving or transmitting another packet of
data on the same Endpoint and direction. FIFO
pairing is controlled by the USB Pairing Control
Register (see UPAIR,
Table 71., page 135
). FIFO
pairing options are listed below:
IN FIFO 1 and 2
OUT FIFO 1 and 2
IN FIFO 3 and 4
OUT FIFO 3 and 4
Note:
When the FIFOs are paired, the CPU must
access the odd numbered FIFO while the even
numbered FIFOs are no longer available for use.
Also when they are paired, the active FIFO is au-
tomatically toggled by the update of USIZE.
■
■
■
■
–
Non-pairing FIFOs Example
Consider a case where the device needs to
send 1024 bytes of data to the host. Without
FIFO pairing (see
Figure 54.
), the CPU loads
the IN Endpoint0 FIFO with 64 bytes of data
and waits until the host sends an IN token to
Endpoint0, and the SIE transfers the data to
the host. Once all 64 bytes have been
transferred by the SIE, the FIFO becomes
empty and the CPU starts writing the next 64
bytes of data to the FIFO. While the CPU is
writing the data to the FIFO, the host is
sending IN tokens to Endpoint0, requesting
the next 64 bytes of data, but only gets NAKs
while the FIFO is being loaded. Once the
FIFO has been loaded by the CPU, the SIE
starts sending the data to the host with the
next IN Endpoint0 token. Again, the CPU
waits until the SIE transfers the 64 bytes of
data to the host. This is repeated until all 1024
bytes have been transferred.
Figure 54. FIFOs with no Pairing
8032
MCU
USB SFRs
Serial
Interface
Engine
CTRL
XDATA
S
F
R
B
u
s
AI10493
Endpoint4 IN FIFO
Endpoint3 IN FIFO
Endpoint2 IN FIFO
Endpoint1 IN FIFO
Endpoint0 IN FIFO
Endpoint0 OUT FIFO
Endpoint1 OUT FIFO
Endpoint2 OUT FIFO
Endpoint3 OUT FIFO
Endpoint4 OUT FIFO
FIFO
Interface
Logic
Endpoint4
Endpoint3
Endpoint2
Endpoint1
Endpoint0
Endpoint0
Endpoint1
Endpoint2
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Endpoint4
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