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參數(shù)資料
| 型號(hào)： | UPSD3424EV-40U6T |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic |
| 中文描述： | Turbo Plus系列高速渦輪8032 USB和可編程邏輯控制器 |
| 文件頁數(shù)： | 193/264頁 |
| 文件大?。?/td> | 4320K |
| 代理商： | UPSD3424EV-40U6T |
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uPSD34xx - PSD MODULE
Output Macrocell.
The GPLD has 16 OMCs. Ar-
chitecture of one individual OMC is shown in Fig-
ure
77
. OMCs can be used for internal node
feedback (buried registers to build shift registers,
etc.), or their outputs may be routed to external
port pins. The user can choose any mixture of
OMCs used for buried functions and OMCs used
to drive port pins.
Referring to Figure
77
, for each OMC there are na-
tive product terms available from the AND-OR Ar-
ray to form logic, and also borrowed product terms
are available (if unused) from other OMCs. The
polarity of the final product term output is con-
trolled by the XOR gate. Each OMC can imple-
ment sequential logic using the flip-flop element,
or combinatorial logic when bypassing the flip-flop
as selected by the output multiplexer. An OMC
output can drive a port pin through the OMC Allo-
cator, it can also drive the 8032 data bus, and also
it can drive a feedback path to the AND-OR Array
inputs, all at the same time.
The flip-flop in each OMC can be synthesized as a
D, T, JK, or SR type in PSDsoft Express. OMC flip-
flops are specified using PSDsoft Express in the
“User Defined Nodes” section of the Design Assis-
tant. Each flip-flop’s clock, preset, and clear inputs
may be driven individually from a product term of
the AND-OR Array, defined by equations in PSD-
soft Express for signals *. c, *.pr, and *.re respec-
tively. The preset and clear inputs on the flip-flops
are level activated, active-high logic signals. The
clock inputs on the flip-flops are rising-edge logic
signals.
Optionally, the signal CLKIN (pin PD1) can be
used for a common clock source to all OMC flip-
flops. Each flip-flop is clocked on the rising edge.
A common clock is specified in PSDsoft Express
by assigning the function “Common Clock Input”
for pin PD1 in the Pin Definition section, and then
choosing the signal CLKIN when specifying the
clock input (*.c) for individual flip-flops in the “User
Defined Nodes” section.
Figure 77. Detail of a Single OMC
D
CLR
PRE
Q
MUX
MUX
M
U
X
M
U
X
PSDsoft
PSDsoft
OUTPUT MACROCELL (OMC)
PT PRESET (.PR)
FROM AND-OR ARRAY
BORROWED
PTs
PT CLEAR (.RE)
NODE FEEDBACK (.FB)
POLARITY
SELECT,
PSDsoft
PT ALLOCATOR,
DRAWS FROM LOCAL
AND GLOBAL UNUSED
PRODUCT TERMS.
PSDsoft DICTATES.
LENDED
PTs
DATA BIT FROM 8032
DATA BIT TO 8032
INDICATES MCU WRITE
TO PARTICULAR CSIO
OMC REGISTER
MCU READ OF
PARTICULAR CSIOP
OMC REGISTER
MCU OVERRIDES
PT PRESET AND
CLR DURING
MCU WRITE
OMC
OUTPUT
FROM AND-OR ARRAY
TO PLD INPUT BUS
FROM AND-OR ARRAY
NATIVE PTs
ALLOCATED PTs
PT CLOCK (.C)
FROM AND-OR ARRAY
GLOBAL CLOCK (CLKIN)
FROM PLD INPUT BUS
8
OMC
ALLO-
CATOR
O
U
T
PRODUCT TERMS
FROM OTHER
OMCs
AI06617A
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