參數(shù)資料
型號： UPSD3423EV-40U6T
廠商： 意法半導(dǎo)體
英文描述： Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic
中文描述： Turbo Plus系列高速渦輪8032 USB和可編程邏輯控制器
文件頁數(shù)： 212/264頁
文件大?。?/td> 4320K
代理商： UPSD3423EV-40U6T
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uPSD34xx - PSD MODULE
212/264
Individual Port Structures.
Ports A, B, C, and D
have some differences. The structure of each indi-
vidual port is described in the next sections.
Port A Structure.
Port A supports the following
operating modes:
MCU I/O Mode
GPLD Output Mode from Output Macrocells
MCELLABx
GPLD Input Mode to Input Macrocells IMCAx
Latched Address Output Mode
Peripheral I/O Mode
■
■
■
■
■
Port A also supports Open Drain/Slew Rate output
drive type options using csiop Drive Select regis-
ters. Pins PA0-PA3 can be configured to fast slew
rate, pins PA4-PA7 can be configured to Open
Drain Mode.
See Figure
85
for details.
Figure 85. Port A Structure
Note: 1. Port pins PA0-PA3 are capable of Fast Slew Rate output drive option. Port pins PA4-PA7 are capable of Open Drain output option.
I/O PORT A
LOGIC
O
U
T
P
U
T
M
U
X
P
D
B
M
U
X
DIRECTION
DRIVE SELECT
CONTROL
DATA OUT
(MCUI/O)
ENABLE OUT
DATA IN (MCUI/O)
D BIT, PERIPH I/O MODE
PT OUTPUT ENABLE (.OE)
LATCHED ADDR BIT
OE
MUX
OUTPUT
ENABLE
TYPICAL
PIN, PORT A
PSD MODULE RESET
ONE of 6
CSIOP
REGISTERS
OUTPUT
SELECT
PERIPHERAL I/O
MODE SETS
DIRECTION
8
1
2
3
4
1
2
3
4
5
6
FROM OMC OUTPUT (MCELLABx)
FROM PLD
INPUT BUS
FROM AND-
OR ARRAY
FROM OMC
ALLOCATOR
D
CLR
DIRECTION
DRIVE
CONTROL
(MCUI/O)
DATA OUT
8032
WR
RESET
PSDsoft
8032 RD
PSELx
WR
RD
PERIPH I/O
DATA BIT
TO IMCs
PIO EN
CSIOP
REGIS-
TERS
Q
Q
Q
Q
DRIVE TYPE SELECT
(1)
8032
DATA
BITS
8032
DATA
BIT
PIN INPUT
CMOS
BUFFER
NO
HYSTERESIS
V
DD
V
DD
PIN
OUTPUT
1 = OPEN
DRAIN,
PA4 - PA7
1 = FAST
SLEW RATE,
PA0 - PA3
IMCA0 - IMCA7
AI09179
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PDF描述
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