參數(shù)資料
型號(hào): UPSD3422EV
廠商: 意法半導(dǎo)體
英文描述: Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic(帶有USB和可編程邏輯的Turbo Plus系列快速Turbo 8032 MCU)
中文描述: Turbo Plus系列高速渦輪8032 USB和可編程邏輯(帶有的USB和可編程邏輯的渦輪加系列快速渦輪8032單片機(jī)微控制器)
文件頁數(shù): 117/293頁
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代理商: UPSD3422EV
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uPSD34xx
I
2
C interface
117/293
A few things to know related to these transfers:
Either the Master or Slave device can hold the SCL clock line low to indicate it needs
more time to handle a byte transfer. An indefinite holding period is possible.
A START condition is generated by a Master and recognized by a Slave when SDA has
a 1-to-0 transition while SCL is high (
Figure 42 on page 117
).
A STOP condition is generated by a Master and recognized by a Slave when SDA has
a 0-to1 transition while SCL is high (
Figure 42 on page 117
).
A RE-START (repeated START) condition generated by a Master can have the same
function as a STOP condition when starting another data transfer immediately following
the previous data transfer (
Figure 42 on page 117
).
When transferring data, the logic level on the SDA line must remain stable while SCL is
high, and SDA can change only while SCL is low. However, when not transferring data,
SDA may change state while SCL is high, which creates the START and STOP bus
conditions.
An Acknowlegde bit is generated from a Master or a Slave by driving SDA low during
the “ninth” bit time, just following each 8-bit byte that is transfered on the bus (
Figure 42
on page 117
). A Non-Acknowledge occurs when SDA is asserted high during the ninth
bit time. All byte transfers on the I
2
C bus include a 9th bit time reserved for an
Acknowlege (ACK) or Non-Acknowledge (NACK).
An additional Master device that desires to control the bus should wait until the bus is
not busy before generating a START condition so that a possible Slave operation is not
interrupted.
If two Master devices both try to generate a START condition simultaneously, the
Master who looses arbitration will switch immediately to Slave mode so it can
recoginize its own Slave address should it appear on the bus.
Figure 42.
Data Transfer on an I
2
C Bus
23.3
Operating modes
The I
2
C interface supports four operating modes:
Master-Transmitter
Master-Receiver
Slave-Transmitter
Slave-Receiver
MSB
7-bit Slave
Address
READ/WRITE
Indicator
Acknowledge
bits from
receiver
Start
Condition
Clock can be held low
to stall transfer.
Repeated if more
data bytes are
transferred.
Repeated
Start
Condition
Stop
Condition
1
2
7
8
9
3-6
1
2
9
3-8
MSB
ACK
ACK
NACK
R/W
AI09625
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PDF描述
UPSD3434EV Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic(帶有USB和可編程邏輯的Turbo Plus系列快速Turbo 8032 MCU)
UPSD3432 Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic
UPSD3432E Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic
UPSD3432E-40T6T Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic
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參數(shù)描述
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UPSD3422EV-40U6 功能描述:8位微控制器 -MCU 8 BITS MICROCONTR RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
UPSD3422EVB40T6 功能描述:8位微控制器 -MCU uPSD34x Turbo Plus Fast Turbo 8032 MCU RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
UPSD3422EVB40U6 功能描述:8位微控制器 -MCU uPSD34x Turbo Plus Fast Turbo 8032 MCU RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
UPSD3433E-40T6 功能描述:8位微控制器 -MCU 8 BITS MICROCONTR RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT